WO2004093072A1 - 圧縮データ編集装置 - Google Patents

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WO2004093072A1
WO2004093072A1 PCT/JP1996/000960 JP9600960W WO2004093072A1 WO 2004093072 A1 WO2004093072 A1 WO 2004093072A1 JP 9600960 W JP9600960 W JP 9600960W WO 2004093072 A1 WO2004093072 A1 WO 2004093072A1
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WO
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pulse
block
audio signal
supplied
code string
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PCT/JP1996/000960
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English (en)
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Inventor
Hiroshi Nakano
Satoshi Takagi
Masahiko Mori
Masao Sasaki
Original Assignee
Hiroshi Nakano
Satoshi Takagi
Masahiko Mori
Masao Sasaki
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Publication date
Application filed by Hiroshi Nakano, Satoshi Takagi, Masahiko Mori, Masao Sasaki filed Critical Hiroshi Nakano
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    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
    • G11B27/02—Editing, e.g. varying the order of information signals recorded on, or reproduced from, record carriers
    • G11B27/031—Electronic editing of digitised analogue information signals, e.g. audio or video signals
    • G11B27/038—Cross-faders therefor
    • G—PHYSICS
    • G11—INFORMATION STORAGE
    • G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
    • G11B27/02—Editing, e.g. varying the order of information signals recorded on, or reproduced from, record carriers
    • G11B27/031—Electronic editing of digitised analogue information signals, e.g. audio or video signals
    • G—PHYSICS
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    • G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B27/00—Editing; Indexing; Addressing; Timing or synchronising; Monitoring; Measuring tape travel
    • G11B27/10—Indexing; Addressing; Timing or synchronising; Measuring tape travel

Definitions

  • the present invention relates to a compressed data editing apparatus for reproducing data-compressed audio data in units of video frames or fields, and performs crossfading when reproducing switched (edited) data. Accordingly, the present invention relates to a compressed data editing apparatus capable of smooth reproduction without noise at switching points (edit points).
  • Audio video recording and reproducing apparatuses for recording and reproducing compressed video data and audio data have been put to practical use.
  • an audio signal sampled at a sampling frequency of 48 kHz is encoded by MPEG (layer I)
  • a block sequence of sample length 3384 is formed.
  • the number of samples of audio data corresponding to one frame of the NTSSC image is 1601 or 1602.
  • the number of coding blocks in one frame does not become an integral number. It is necessary to divide the block in the middle.
  • blocks before and after the switching point (editing point) have a state in which some data is lost. This is because in the worst case, that is, when there are 383 samples each before and after the frame boundary, the data is incomplete in the section of 7666 samples, The decoding of the interval of 2 5 6 samples I can't.
  • FIG. 17 shows a configuration example of the encoding device 100 of such a system
  • FIG. 18 shows a configuration example of the decoding device 200.
  • the audio signal 101 is a digital signal sampled at 48 kHz.
  • T is the sampling period 20.8 sec.
  • the audio signal 101 is supplied to an audio signal input terminal of an MPEG encoding circuit 105 for encoding the MPEG layer I.
  • the block pulse 102 is a pulse signal that becomes active every 384 T, and is supplied to one input terminal of the MPEG encoding circuit 105 and one input terminal of the phase comparison circuit 106.
  • the input frame pulse 103 is a pulse signal that synchronizes the frame frequency 29.97 Hz to the sampling frequency 48 kHz, that is, a pulse signal that becomes active every 1601 T or 1602 T .
  • the input frame pulse 103 is supplied to the other input terminal of the phase comparison circuit 106.
  • the code frame pulse 104 is a signal indicating the output phase of the code string 109 output from this encoder in frame units, and is also a pulse that becomes active every 1601T or 1602T. Signal.
  • the code frame pulse 104 is supplied to the memory circuit 107.
  • the audio signal 101 supplied to the MPEG encoding device 105 is converted into an MPEG code sequence, and is sequentially written in the memory circuit 107.
  • the lock pulse 102 supplied to the phase comparator 106 and the input frame pulse 103 are compared in phase, and each pulse is compared.
  • Information indicating the first audio coding block in the frame unit and information indicating the offset amount (phase difference) from the frame boundary of the first block are output.
  • Information indicating the head block of this frame is written to the memory circuit 107, and information indicating the offset amount is supplied to the offset adding circuit 108.
  • the input audio signal 101 supplied to the MPEG encoding circuit 1 ⁇ 5 is subjected to encoding processing in units of a block at the timing of the block pulse 102 supplied together, and the memory circuit 107 and the offset are processed. It is output as a code string 109 via the add-on circuit 108. Therefore, if the relative phase (offset) of the work pulse 102 to the input frame pulse 103 is recorded in the video frame unit recording apparatus, the audio / video relative phase at the time of input / output is preserved. When the audio data recorded in frame units is output after being decoded, the recorded relative phase indicates the audio output phase with respect to the output reference video frame. Will be saved.
  • a sequential M PEG code sequence is read based on the code frame pulse 104.
  • the read MPEG code string is supplied to an offset adding circuit 108, to which an offset is added, and output as a code string 109.
  • the code string 201 generated by the above-described encoding device 100 is sequentially written into the memory circuit 205, and the offset extracting circuit 2 Supplied to 06.
  • the offset extracting circuit 206 the offset value added by the encoder is extracted from the code string 201, and is supplied to one input terminal of the phase calculating circuit 207.
  • An output frame pulse 204 is supplied to the other input terminal of the phase calculation circuit 207.
  • the phase calculation circuit 207 a signal which breaks the phase of the first audio coding circuit of each frame based on the output frame pulse 204 based on the offset value extracted from the code string 201. It is generated and supplied to the memory circuit 205.
  • a pre-written code string is read from the memory circuit 205 and supplied to the MPEG decoding circuit 208.
  • the supplied code string is converted into an audio signal, and output to the outside as an audio signal output 209.
  • the audio signal is encoded by the encoding device 100, and when the encoded audio signal is switched or edited in frame units, the encoded audio signal is decoded by the decoding device 200. Will be described.
  • the first pulse of the playback block created from the offset recorded in the switched or edited code string is divided in the middle of the frame unit because the coding block is divided in the middle. It is no longer the T period, and the read operation of the memory 205 is not continuous. Therefore, as shown in FIG. 19, at this discontinuity, an incomplete block of data or a gap occurs. At this time, the output of the MPEG decoder 208 generates noise. Therefore, such a conventional configuration requires mute.
  • FIG. 20 shows a configuration example of a decoding device 200 ′ including the mute circuit 210.
  • the mute circuit 210 is controlled by a signal indicating mute timing supplied from the phase operation circuit 207, and the output of the MPEG decoding circuit 208 is muted. Is done.
  • the conventional configuration example but it is necessary to mute the data, and there is a problem that the sound quality is deteriorated due to the muting at the switching point (edit point). there were. Disclosure of the invention
  • an object of the present invention is to enable smooth switching (editing) without noise in a device that reproduces audio data that has been compressed over time in units of video frames or fields.
  • Another object of the present invention is to provide a compressed audio data editing apparatus.
  • the present invention encodes an input audio signal in units of an input block pulse, detects phase difference information between the block pulse and a frame of a video signal, and codes the signal.
  • An encoding means for adding and outputting to the code string, and detecting and outputting an offset value from the phase difference information from the code string supplied from the encoding means and outputting the offset value when the offset value of the parentheses is out of a predetermined value range.
  • An offset extracting means for outputting a repeat pulse if any; a phase calculating means for outputting a block leading pulse from a frame pulse of a video signal and an offset value supplied from the offset extracting means;
  • the decoding of the input code string is stopped for a predetermined period, and when the repeat pulse is not supplied, the code string is decoded.
  • An audio signal from the decoding means is started from the position of the leading pulse supplied from the decoding means outputting the audio signal and the phase calculation means, and the repeat pulse supplied from the offset extracting means is outputted.
  • the audio signal is not written from the position of the first pulse of the block, and when the first pulse of the block is input, the written audio is started from the position of the pulse.
  • Memory means comprising: a first output system for reading and outputting an audio signal; and a second output system for outputting an audio signal following the audio signal output from the first output system for a predetermined period from a block start position.
  • cross-feed processing means for cross-feed processing the audio signal supplied from the memory means from the position of the leading pulse of the blog from the phase calculation means for a predetermined period and outputting an audio signal. It is a compressed data editing device.
  • an input audio signal is encoded in units of an input block pulse, and phase difference information between a block pulse and a frame pulse of a video signal is detected.
  • Encoding means for adding phase difference information to the encoded code sequence and outputting the code sequence; offset extracting means for detecting and outputting an offset value from the phase difference information of the code sequence output from the encoding device; Offset value supplied from the offset extracting means, phase calculating means for receiving a frame pulse of the video signal and outputting a block leading pulse in the frame, and switching indicating the position information of the edit point of the video signal
  • a switching means for supplying a pulse, and when a switching pulse is inputted, the decoding of the code string supplied from the encoding means is stopped for a predetermined period.
  • a decoding unit that decodes the input code string to convert it into an audio signal and outputs the audio signal, and when a block top pulse supplied from the phase calculation unit is input, the position of the pulse
  • the writing of the audio signal output from the decoding circuit is started and the switching pulse supplied from the switching means is supplied, the first code string after the edit point from the block of the code string before the edit point is supplied.
  • the first output system that reads the audio signal written from the position to which the block top pulse was supplied is not written until immediately before the block block.
  • a memory means comprising a second output system for outputting an audio signal following the audio signal output from the first output system for a predetermined period from the input position, and a phase with respect to the audio signal supplied from the memory means.
  • a compressed data editing apparatus characterized by comprising cross-feed processing means for performing cross-feed processing for a predetermined period from the position of the block leading pulse supplied from the arithmetic means and outputting an audio signal.
  • an input audio signal is encoded in units of an input pulse signal, and a phase difference between the pulse signal and a frame pulse of the input video signal is detected.
  • Encoding means for adding and outputting the encoded information as phase difference information to the encoded sequence, detecting phase difference information from the code sequence supplied from the encoding unit, detecting and outputting an offset value, and
  • An offset extracting means for outputting a repeat pulse if the offset value is out of a predetermined value range; and, when a repeat pulse supplied from the offset extracting means is inputted, a code string of a continuous frame having no edit point is inputted.
  • the decoding unit decodes the code string, and when no repeat pulse is input, decodes the code string, converts it into an audio signal, and outputs it.
  • Phase calculation means that receives the offset value and the frame pulse of the video signal and outputs the block head pulse, the block head pulse supplied from the phase calculation means, and the repeat pulse supplied from the offset extraction means Is input, the audio signal supplied from the decoding means is written from the position of the block leading pulse, and the audio signal corresponding to the continuous audio signal having no edit point and the code string supplying the repeat pulse is No writing is performed for a predetermined period,
  • the first output system that reads and outputs the audio signal written from the pulse position when the first pulse is input, and the audio that is read from the first output system for a predetermined period from the position of the first block pulse
  • a memory means comprising a second output system for reading and outputting an audio signal following the signal, and an audio signal supplied from the memory means being inputted, and from a position of a leading block pulse supplied from the phase calculating means.
  • a compressed data editing apparatus comprising: a cross feed means for performing a cross feed process for a predetermined period and outputting an audio signal.
  • the first output system of the phase adjustment unit outputs the decoded signal at a position where the relative phase information has been corrected with respect to the output reference video signal
  • the second output system of the phase adjustment unit outputs
  • FIG. 1 is a block diagram showing an example of the configuration of a decoding device according to the present invention
  • FIG. 2 is a schematic diagram showing input / output signals of an MPEG encoding circuit
  • FIG. FIG. 4 is a schematic diagram for explanation
  • FIG. 4 is a schematic diagram showing the operation of a memory circuit in the encoding device according to the present invention
  • FIG. 5 is a diagram showing editing performed by the decoding device of the first embodiment.
  • FIG. 6 is a schematic diagram showing an example of each input / output signal when no operation is performed
  • FIG. 6 is a schematic diagram showing an operation of a memory circuit in the decoding device according to the first embodiment
  • FIG. Fig. 8 is a schematic diagram showing cross-feed processing at a code string switching point (edit point).
  • FIG. 8 is a schematic diagram showing a comparison between the output of audio signal switching and the decoding of code string switching.
  • FIG. 9 is a diagram showing the fifth embodiment to the fifth block in the first embodiment. 1 4 block code string
  • FIG. 10 is a schematic diagram showing an example lost by switching (editing).
  • FIG. 10 is a schematic diagram showing an example in which MPEG (Laye rl) data is put on a video frame of 525 / 59.94 system in the second embodiment.
  • FIG. 11 is a diagram showing an example in which, in the second embodiment, some code strings of the sixth block to the eighth block, the fifth block and the ninth block are lost by switching (editing).
  • FIG. 12 is a schematic diagram showing an example in which MPEG (Layer II) data is put on a 625/50 video frame in the third embodiment
  • FIG. 13 is a third embodiment.
  • FIG. 14 is a schematic diagram showing an example in which the third block and a part of the code sequence of the second and fourth blocks have been lost by switching (editing).
  • FIG. 14 is a schematic diagram showing a continuous sequence in the fourth embodiment.
  • FIG. 16 is a schematic diagram showing an example of each input / output signal in the decoding device when the repeat flag is set at the beginning of a discontinuous frame in the fourth embodiment
  • FIG. 17 is a block diagram showing an example of a configuration of an encoding device in a system in which the ratio between a block period and a video frame period is not integral
  • FIG. 18 is an example of a configuration of a decoding device in a conventional example.
  • FIG. 19 is a schematic diagram illustrating an example of processing of a frame-switched code string
  • FIG. 20 is an example of a decoding device including a mute circuit according to the related art. It is a block diagram.
  • FIG. 1 shows an example of the configuration of a decoding device according to this embodiment.
  • the MPEG Layer I
  • the following describes an example in which a video frame is placed on a video frame in the form of 525.59.94.
  • an encoding device corresponding to this decoding device for example, an encoding device 100 according to the related art shown in FIG. 17 is applied.
  • the positions of the MPEG decoding circuit and the memory circuit are replaced with those of the above-described conventional decoding device 200.
  • the audio signal 101 is supplied to the MPEG encoding circuit 105.
  • the MPEG encoder 105 is also supplied with a work pulse 102.
  • the MPEG encoding circuit 105 supplied with these signals outputs data corresponding to the audio signal 101 in the 384 T section indicated by the block pulse 102. Is output with a certain amount of delay. This output is supplied to the memory circuit 107.
  • the memory circuit 107 includes a memory in which data is written and a circuit for controlling writing and reading to and from the memory.
  • the above-described block pulse 102 and the input frame pulse 103 are supplied to the phase comparison circuit 106, and the head block belonging to the frame is determined by these signals. That is, as shown in FIG. 3, a section having a width of 384 T is set before and after the position of the frame pulse. Since there is always one block pulse in this set section, the block starting from this pulse is set as the head block of the frame. A signal indicating the first block in this frame is supplied to the memory circuit 107. .
  • the position of this work pulse is output as an offset value.
  • a range from 192 T to +191 T or a range from 351 T to +32 T is set around the frame pulse.
  • a range from 351 T to +32 T is set. This offset value is supplied to the offset adding circuit 108.
  • Data (code sequence) corresponding to the audio signal output from the MPEG encoding circuit 105 is written in the memory circuit 107, and a signal indicating the first block output from the phase comparison circuit 106 supplied together is written. 5 blocks are read out per frame based on the signal. Therefore, the code string of the audio data output from the memory circuit 107 is divided by the sample length 320 per frame.
  • FIG. 4 shows the read timing of this block. As shown in FIG. 4, the output from the memory circuit 107 is synchronized with the code frame pulse 104 because it is divided in units of the code string 320T. However, when output from the memory circuit 107, the code sequence encoded by the MPEG encoding circuit 105 includes four blocks in one frame, but the fifth block is output from the phase comparison circuit 106.
  • the first block pulse makes it the first block of the next frame, and may be output twice. That is, there are a case where the blocks are sequentially read out, and a case where the same block is repeatedly read twice at the frame boundary as in the fifth block and the fourteenth block in FIG. Further, a code frame pulse 104 is also supplied to the memory circuit 107, and the read start phase is given by the code frame pulse 104. This data read from the memory circuit 107 is supplied to the offset adding circuit 108, and the phase ratio is added to the beginning of each frame or the beginning of each block.
  • the code string 10 is supplied to both the M PEG decoding circuit 2 and the offset extracting circuit 3.
  • the offset extraction circuit 3 is also supplied with a work pulse 11 and a code frame pulse 12.
  • One output of the offset extracting circuit 3 is supplied to both the MPEG decoding circuit 2 and the memory circuit 4.
  • the other output of the offset extraction circuit 3 is supplied to one input terminal of the phase calculation circuit 5.
  • An output frame pulse 13 is supplied to the other input terminal of the phase calculation circuit 5.
  • One output of the phase calculation circuit 5 is supplied to the memory circuit 4, and the other output is supplied to the cross-fade circuit 6.
  • the output of the MPEG decoding circuit 2 is supplied to the memory circuit 4.
  • the memory output A and the memory output B of the memory circuit 4 are supplied to the cross-fade circuit 6, respectively.
  • the output of the crossfade circuit 6 is output to the outside as an audio signal 14.
  • the code string 10 supplied to the M PEG decoding circuit 2 is decoded to be converted into an audio signal (decoded output) after a certain amount of delay.
  • FIG. 5 shows an example of each input / output signal in the decoding device 1 that has not been edited.
  • the operation of the MPEG decoding circuit 2 is temporarily stopped for the repeated block.
  • the fifth block is repeatedly recorded at the time of encoding. This can be detected from the offset value obtained by the offset extracting circuit 3. That is, if the extracted offset value is out of a predetermined value, in this example, the range of ⁇ 32, a repeat pulse is output by the offset extraction circuit 3, and the repeat pulse is supplied to the MPEG decoding circuit 2. .
  • the MPEG decoding circuit 2 The decoding process is suspended in the fifth block, which is the code block recorded for the second time, corresponding to this pulse, and the process starts after the next sixth block is input.
  • This suspension of the decoding process is a necessary process for the decoding process when the data near the block boundary is repeatedly recorded.
  • the supplied code string 10 is supplied to, for example, a synthetic filter having 5 12 taps in the MPEG decoding circuit 2, and is converted into an audio signal. For this reason, the data of 256 samples near the boundary between adjacent blocks is affected by each other, and as a result, a correct audio signal is output.
  • the process at this time will be described with reference to FIG. 3rd block
  • the fifth block of the decoded output corresponding to the code sequence of the fourth block and the fifth block is input to the MPEG decoding circuit 21.
  • a code string with a repeat flag (the fifth block to which the code string is marked with “R,” referred to as a 5 c R ′ block) is input to the MPEG decoding circuit 2.
  • Purodzuku (not shown) is outputted from the MP EG decoding circuit 2.
  • the sixth block of the corresponding decoded output Is output.
  • the sixth block of the decoded output is written again on the fifth and the fifth decoded output of which the repeat flag has been set, so that the fifth block is executed similarly to the temporary stop of the decoding of the code string.
  • the code string data of the sixth block and the sixth block are continuously processed, and the data near the boundary is correctly decoded.
  • the output of the MPEG decoding circuit 2 lacks blocks, as shown in the decoded output of FIG. This output is supplied to the memory circuit 4.
  • the output of the offset extracting circuit 3 is supplied to the phase calculating circuit 5 together with the output frame pulse 13.
  • the phase operation circuit 5 performs an operation based on these signals, and outputs a write head pulse which receives a delay required for the processing of the MPEG decoding circuit 2 from the code frame pulse 12.
  • the output head pulse and the repeat pulse detected from the offset extracting circuit 3 are supplied to the memory circuit 4.
  • the processing clock for the write processing of the MPEG decoding circuit 2 and the memory circuit 4 is a frequency that handles data for five blocks per frame (1920 samples), and the read processing of the memory circuit 4 Processing
  • the clock is a frequency that handles 1602/1601 samples of data per frame.
  • the memory circuit 4 has a time base function, whereby the decoded output supplied intermittently is converted into a continuous audio signal on the time axis.
  • the writing of the decoded output to the memory circuit 4 is started from the position of the write leading pulse supplied from the phase operation circuit 5.
  • writing of the first block is not performed, and writing is performed from the second block. Therefore, only the blocks shown in the decoded output of FIG. 'Reading from the memory of the memory circuit 4 is divided into two systems, a reading A and a reading B, and these read data are output as a memory output A and a memory output B, respectively.
  • the read A the read is performed from the position of the head pulse of the program created from the output frame pulse and the offset, and the head read address is corrected for each block. In a continuous signal, the corrected read address is not different from that before correction, and continuous data is read and output as memory output A.
  • FIG. 6 shows the operation of the memory circuit 4 of the decoding device 1. Thus, the address of the first block is corrected and output by the offset.
  • a memory output is obtained from the beginning of the block for the crossfade period (512 samples in the example of FIG. 5).
  • memory output A and memory output B have the same data.
  • These memory outputs A and B are supplied to a cross-fade circuit 6 and output as an audio signal 14 after being subjected to cross-fade processing.
  • the output audio signal 14 is the memory output A in the example of FIG. It will be the same day.
  • Fig. 7 shows the cross-feed processing at the switching point (edit point) of the code string.
  • the code strings of the fifth block to the ninth block have been lost by switching (editing).
  • the decoding processing of the input code string is temporarily performed. Stopped.
  • the output of the M PEG decoding circuit 2 lacks a block as shown in the decoding output of FIG. 7, and this signal is supplied to the memory circuit 4.
  • FIG. 8 shows a comparison between the output in the case of switching the audio signal and the output in the case of decoding the switching of the code string.
  • FIG. 8A and FIG. 8B show the signal at the switching point of the audio signal of the close frequency.
  • FIG. 8A shows a signal at a switching point in a general audio signal
  • FIG. 8B shows a signal at a switching point in subband decoding.
  • the position of 0 on the horizontal axis is the switch. This is the ching point.
  • FIG. 8C and FIG. 8D show a case where the frequency difference between the two signals to be switched is large.
  • FIG. 8C shows a signal at a switching point in a general audio signal
  • FIG. 8D shows a signal at a switching point in subband decoding. In this way, a smooth output that does not include noise components can be obtained even at the switching point (edit point) due to the effect of the MPEG composite filter.
  • Reading from the memory for the decoded output written to the memory from the position of the leading write pulse is divided into two systems: read A and read;
  • the read A the read is performed from the position of the block leading pulse generated from the output frame pulse and the offset, and the leading read address is corrected in each block. Therefore, as shown in Fig. 7, at the position of the block top pulse corresponding to the block switched by switching (editing), the second half of the fifth block is missing, and the top of the 10th block continues. Is output.
  • a decoded output is output only from the head of the program for a crossfade period (512 samples in the example of FIG. 7).
  • the data following the data read by read A immediately before the beginning of the block is read. That is, the decoded output of the second half of the fifth block missing in the readout A is read out, and subsequently, the decoded output at the head of the 10th block is read out and output as the memory output B.
  • memory outputs A and B are both supplied to the cross-feed circuit 6, subjected to cross-feed processing, and output as an audio signal 14.
  • This cross feed processing is performed for a cross feed period (512 samples in the example of FIG. 7) from the position of the block leading pulse. Except for the switching point (edit point), memory output A and memory output B
  • the output signal subjected to the cross feed processing is shown as ade output in FIG.
  • the crossfade gain is shown by diagonal lines. Since both memory outputs A and B are smooth signals due to the composite fill effect, a noise-free output can be obtained as a cross-fade output.
  • FIG. 9 shows an example in which the code strings of the fifth block to the 14th block have been lost by switching (editing). Also in this case, by performing the same processing as in FIG. 7, an output without noise is obtained as a cross-fade output.
  • FIGS. 10 and 11 show an example in which the data of MPEG (LayerI) is put on a video frame of the 5255 / 59.94 system as in the first embodiment.
  • MPEG LayerI
  • data for 1601 or 1602 samples is recorded per frame.
  • the offset value is recorded for each frame.
  • the code frame pulse and the code sequence are in phase, this offset value is zero.
  • the interval between the head of the block immediately after the frame pulse and the frame pulse is set to offset.
  • the offset of the first frame is 0, and the offset of the second frame is the section indicated by the arrow in the figure.
  • the decoding device 1 shown in FIG. 1 is used as in the first embodiment.
  • the code string 10 supplied to the MPEG decoding circuit 2 is converted into an audio signal (decoded output) after being delayed by a certain amount, and supplied to the memory circuit 4.
  • the code frame pulse 12 is delayed and generated by the offset extracting circuit 3.
  • the written write start pulse is also supplied. Writing of the decrypted output to the memory of the memory circuit 4 is started from the position of the supplied leading pulse.
  • Reading from the memory of the memory circuit 4 is divided into two systems, a reading A and a reading B. Reading of the decoded output written in the memory circuit 4 is performed from the output frame pulse 13 and the offset extracted by the offset extracting circuit 3 from the offset extracted by the offset extracting circuit 3. This is performed from the position of the pulse, and the head read address is corrected in the program. In a continuous signal, the corrected read address is not different from that before correction, and a continuous data is read out and output as a memory output A.
  • a switching flag signal 16 indicating which switching was performed by the switching device 15 in the editing device is sent to the MPEG decoding circuit 2, the memory circuit 4, and the cross feed circuit 6 of the decoding device 1.
  • blocks that are edited by switching can have a switching flag set.
  • the read B outputs 0 when this switch flag is not detected by the memory circuit 4.
  • the cross feed processing is not performed in the cross feed circuit 6, and the memory output A is output as the audio signal 14 as it is.
  • FIG. 11 shows the cross feed processing of the switching points (edit points) of the code string 10.
  • a part of the code sequence of the sixth block to the eighth block, the fifth block, and the ninth block is lost by switching (editing).
  • the decoding process before the switching that is, the frame before the edit point, in this example, from the fourth block onward until the first block after the switching is supplied to the composite file. Is paused.
  • the output of the MPEG decoding circuit 2 becomes a missing block as shown in the decoded output of FIG. 11, and is supplied to the memory circuit 4.
  • writing of the decoded output to the memory of the memory circuit 4 is started from the position of the leading write pulse supplied to the memory circuit 4. At this time, in the frame in which the switching flag is set, writing of the frame before switching, in this example, up to immediately before the first block after switching from the fourth block is not performed. Writing is performed from the beginning of the first block after switching. Therefore, only the blocks shown in the decoded output of FIG. 11 are written to the memory of the memory circuit 4.
  • Reading from the memory of the memory circuit 4 is divided into two systems, a reading A and a reading B. Reading of the decoded output written in the memory circuit 4 Reading from A is performed by the phase calculation circuit 5 based on the output frame pulse 13 and the offset extracted by the offset extraction circuit 3, It is performed from the pulse position, and the top read address is corrected in block No. Therefore, as shown in FIG. 11, at the position of the first pulse of the block corresponding to the block switched by switching (editing), the second half of the block of the first block is missing, and the block of the 10th block is lost. The output follows the beginning. Further, when the switching flag rises, the output frame pulse 13 is switched from the position of the output frame pulse, which is delayed by three strokes, to the next block. As a result, the readout A from the memory is shown in FIG. Output as indicated by memory output A.
  • the third and tenth blocks which are the code blocks, are adjacent to each other.
  • samples near the boundary between adjacent blocks affect each other due to the effect of the composite filter in the decoding process, and a smooth output is obtained.
  • Readout B is output from the beginning of the block only for the cross feed period (512 samples in the example of Fig. 11). Immediately before the beginning of the block, the data following the data read by read A is read. That is, the second half of the eleventh block missing in the readout A is read out, and then the head of the twelfth block is output.
  • the memory outputs A and B are supplied to a cross-fade circuit 6, subjected to cross-fade processing, and output as an audio signal 14.
  • This cross-fade processing is performed only when the switching flag is detected, and the cross-feed period (5 in the example of the figure) starts from the position of the first pulse of the block supplied from the phase operation circuit 5 to the cross-fade circuit 6. 12 samples).
  • the cross-processed audio signal 14 is shown in FIG. 11 as an Xfade output.
  • the cross-feed gain is indicated by diagonal lines. Since both memory outputs A and B are smooth signals due to the synthesis filter effect, a noise-free output can be obtained as a crossfade output.
  • FIG. 12 and FIG. 13 show examples in which MPEG (Layerll) data is put on a video frame of the 625/5/5 system.
  • the block length is 1 152 samples.
  • one frame after the audio signal is encoded 192 samples of data are recorded per time, and the offset value is recorded every frame.
  • the offset value is 0.
  • the interval between the beginning of the block immediately after the frame pulse and the frame pulse is offset.
  • the offset of the first frame is 0, and the offset of the second frame is a section indicated by an arrow in the figure.
  • the decoding device 1 shown in FIG. 1 is used as in the first and second embodiments.
  • the code string 10 supplied to the MPEG decoding circuit 2 is converted into an audio signal (decoded output) after a certain amount of delay, and supplied to the memory circuit 4.
  • the memory circuit 4 is also supplied with a write start pulse generated by delaying the code frame pulse 12 by the offset extracting circuit 3. Writing of the decoded output to the memory of the memory circuit 4 is started from the position of the supplied write head pulse.
  • Reading from the memory of the memory circuit 4 is divided into two systems, a reading A and a reading B. Reading of the decoded output written in the memory circuit 4 is performed by the phase arithmetic circuit 5 based on the output frame pulse 13 and the offset extracted by the offset extracting circuit 3 from the offset extracted by the offset extracting circuit 3. It is performed from the position of the head pulse, and the head read address is corrected for each block. In a continuous signal, the corrected read address is not different from that before correction, and continuous data is read and output as the memory output A.
  • a switching flag signal 16 indicating which block has been switched by the switching device 15 in the editing device is supplied to the MPEG decoding circuit 2, the memory circuit 4 and the cross feed circuit 6 of the decoding device 1.
  • switch A switching flag can be set for a block edited by switching (editing).
  • the read B outputs 0.
  • the crossfade circuit 6 does not perform the crossfade processing, and the readout A is output as it is as the audio signal 14.
  • FIG. 13 shows the crossfading processing of the switching points (edit points) of the code string 10.
  • the third block and a part of the code sequence of the second block and the fourth block are lost by switching (editing).
  • the decoding process is temporarily stopped.
  • the switch flag is detected by the MPEG decoding circuit 2
  • the decoding process is temporarily suspended until the data is supplied, so that the output of the MPEG decoding circuit 2 lacks a block, as shown in the decoding output of FIG. Is entered.
  • the writing of the decoded output to the memory is started from the position of the write leading pulse. At this time, in the frame where the switching flag is set, writing is not performed from the second block and subsequent blocks of the frame before switching to immediately before the first block after switching, and writing is performed from the first block. Done. Therefore, only the blocks shown in the decoded output of FIG. 13 are taken into the memory of the memory circuit 4.
  • Read from the memory of memory circuit 4 is read A and read
  • the system is divided into two systems. Readout of the decoded output written in the memory circuit Readout from A is performed by the phase calculation circuit 5 based on the output frame pulse 13 and the offset extracted by the offset extraction circuit 3. This is performed from the position of the first pulse, and the first read address is corrected for each block. Therefore, as shown in Fig. 13, at the position of the first pulse of the work corresponding to the work switched by the editing (editing), the second half of the sixth block is missing, and the fifth block is omitted. The output follows the beginning. Further, when the switching flag is set, the output frame pulse 13 is switched from the position of the output frame pulse, which is delayed by one block, to output the block immediately after. As a result, the readout A from the memory is output as the memory output A shown in FIG.
  • a first block and a fifth block which are code blocks, are adjacent to each other at a switching point (edit point).
  • the samples near the boundaries between adjacent blocks influence each other due to the effect of the composite filter in the decoding process, and a smooth output is obtained. .
  • Readout B is output from the beginning of the block only during the crossfade period (5 12 samples in the example in Fig. 13). Immediately before the beginning of the block, the data following the data read by read A is read. That is, the latter half of the block 6 missing in the read A is read and output as the memory output B.
  • the memory outputs A and B are supplied to the cross-fade circuit 6, cross-fed, and output as an audio signal 14.
  • This cross-fade processing is performed only when a switching flag is detected, and the block destination supplied from the phase operation circuit 5 to the cross-fade circuit 6 is A cross-fade period (5 12 samples in the example in the figure) is performed from the position of the head pulse.
  • the cross-fade-processed audio signal 14 is shown in FIG. 13 as an X fade output.
  • Crossfade gain is shown as diagonal lines. Since both memory outputs A and B are smooth signals due to the composite fill effect, a noiseless output can be obtained as a cross feed output.
  • FIG. 1 the decoding device 1 shown in FIG. 1 is used as in the first embodiment described above.
  • the decoding operation is suspended, as in the first, second, and third embodiments described above.
  • the decoding operation is not suspended.
  • the processing when the repeat flag is not set at the head of the discontinuous frame is the same as in the first, second, and third embodiments.
  • the processing when a repeat flag is set at the head of a discontinuous frame is different from these examples, and the decoding operation is not temporarily stopped.
  • FIGS. 14, 15 and 16 respectively show the data of MP EG (Layer I) in the decoding device 1 in these cases. The following shows an example of each input / output signal when the video frame is loaded on a video frame of the system.
  • the code string 10 supplied to the MPEG decoding circuit 2 is converted into an audio signal (decoded output) after a certain amount of delay.
  • the operation is temporarily stopped for a block repeated in a continuous frame, and decoding is always performed at the head of a discontinuous frame.
  • block 1, block 14, block 18 And the 22nd block are repeatedly recorded at the time of encoding. This can be detected from the offset value, and this offset value is outside the range of the predetermined value.
  • the phase comparison circuit 10 Since it is set from 135 T to +3 '2 T, if it is out of the range of ⁇ 32, the detected repeat pulse is supplied from the offset extraction circuit 3 to the MPEG decoding circuit 2. Is done. At this time, a repeat flag is set.
  • the MPEG decoding circuit 2 if the code block recorded for the second time corresponding to this pulse is a continuous frame, the decoding process is suspended, and the process is started after the next block is input. . In the example of FIG.
  • the decoding processing of the first block, the 18th block, and the 22nd block is temporarily stopped.
  • the 14th block which is the first block of a discontinuous frame, is executed without stopping the decoding process. If the repeat flag is set at the beginning of consecutive frames, the decoding process is suspended. This suspension processing is necessary for decoding data near the block boundary.
  • the supplied code string 10 is supplied to, for example, a synthetic filter of 5 12 taps in the MPEG decoding circuit 2 and is converted into an audio signal. For this reason, 256 samples of data near the boundary between adjacent blocks are affected by each other, and as a result, a correct audio signal is output.
  • the decoding process is temporarily stopped, so that the block and the code string data of the block appear to be continuous. And the data near the boundary is correctly decoded.
  • the output of the MPEG decoding circuit 2 lacks a block, as shown in the decoded output of FIG. This output is supplied to the memory circuit 4.
  • the output of the offset extracting circuit 3 is supplied to the phase calculating circuit 5 together with the output frame pulse 13.
  • the phase operation circuit 5 performs an operation based on these signals, and outputs a write start pulse which receives a delay required for the processing of the MPEG decoding circuit 2 from the code frame pulse 12.
  • the output head pulse and the repeat pulse detected from the offset extraction circuit 3 are supplied to the memory circuit 4.
  • the processing clock of the write processing of the MPEG decoding circuit 2 and the memory circuit 4 is a frequency that handles five blocks of data (192 samples) per frame, and the processing of the read processing of the memory circuit 4
  • the clock is a frequency that handles the data of 1602/1601 samples per frame.
  • the memory circuit 4 has a time base function, whereby the decoded output supplied intermittently is converted into a continuous audio signal on the time axis.
  • the writing of the decoded output to the memory is started from the position of the write leading pulse. However, at this time,
  • the fifth block which is a code block, and the 14th block are adjacent to each other.
  • samples near the boundary between adjacent blocks affect each other due to the effect of the synthesis filter in the decoding process, and a smooth output is obtained. can get. .
  • Reading from the memory of the memory circuit 4 is divided into two systems, a reading A and a reading B. Read A is performed from the position of the block top pulse created by the phase calculation circuit 5 from the output frame pulse 13 and the offset extracted by the offset extraction circuit 3, and the start read address is corrected for each block. Is done. Therefore, as shown in FIG. 16, at the position of the first pulse of the block corresponding to the block switched by switching (editing), the second half of the fifth block is missing, and the first of the 14th block is lost. Then it is output.
  • the timing of read B is always 256 samples before the output frame pulse, so that the center of the cross feed is always located at the position of the output frame pulse.
  • FIGS. 14, 15 and 16 show the read B timing as an Xfade start pulse.
  • Readout B is output from the position of the Xfade start pulse only for the cross-feed period (512 samples in the example of FIG. 16).
  • the data following the data that was read out immediately before by readout A is read out. That is, in the discontinuous portion of FIG. 16, the second half of the fifth block read in the read A is read, and then the beginning of the fourteenth block is output.
  • the memory outputs A and B are supplied to a cross-fade circuit 6, subjected to cross-fade processing, and output as an audio signal 14.
  • This cross-fade processing is performed every time from the position of the X fade start pulse to the position of the first block, except for the cross-fade period (in the example of Fig. 16, 5 12 samples) and the switching point (edit point). .
  • the memory output A and the memory output B become the same signal except at the switching point (edit point).
  • the number does not change.
  • the audio signal 14 which has been subjected to the cross-fade processing is shown as an X fade output in FIG.
  • the cross feed gain is indicated by diagonal lines. Since both memory outputs A and B are smooth signals due to the effect of the synthesis filter, a noise-free output can be obtained as a cross-fade output.
  • This embodiment is different from the method according to the first embodiment described above in that the processing method is different between the case where a continuous frame is decoded and the case where a discontinuous frame is decoded.
  • the memory output B at the discontinuous point shown in FIG. 16 becomes the 14th block and the 15th block, which are smoother than the cross-fade output shown in FIG. 9 in the first embodiment described above. Become.
  • the cross-feed processing according to this example is performed as described above. It is not necessary to perform this at the position of the first block every time other than the switching point (editing point), and may be performed only at the position of the first block of the discontinuous frame.
  • the cross-fade start timing is determined to be a constant phase with respect to the output frame pulse. can do. Also, an arbitrary period can be selected for the crossfade period.
  • the compressed data recording unit is a frame, but this is not limited to this example.
  • one or a plurality of fields may be used as a unit.

Description

明 細 書
発明の名称
圧縮データ編集装置
技術分野
この発明は、 データ圧縮されたオーディオデータをビデオフレーム 、 若しくはフィ一ルド単位で再生するような圧縮データ編集装置に関 し、 スイッチング （編集） されたデータを再生する際にクロスフエ一 ドをかけることによって、 スイッチング点 （編集点） においてノイズ のない滑らかな再生が可能な圧縮デ一夕編集装置に関する。
背景技術
圧縮されたビデオデータやオーディオデータを記録再生するような オーディオビデオ記録再生装置が実用化されている。 このような装置 において、 4 8 k H zのサンプリング周波数でサンプリングされたォ —ディォ信号が M P E G (レイヤ I ) により符号化されると、 サンプ ル長 3 8 4のブロック列ができる。 一方、 N T S C画像の 1 フレーム に対応するオーディオデータのサンプル数は、 1 6 0 1または 1 6 0 2である。
このように、 サンプル長 3 8 4を単位符号化プロヅクとする符号化 では、 1 フレーム中の符号化プロック数が整数個にはならないので,、 フレームに同期した信号列を作るためには、 符号化されたプロックを 途中で分割する必要がある。 このような符号をフレーム単位でスィ ヅ チング (編集) した後に復号化する場合、 スイ ッチング点 (編集点) の前後のブロックは、 一部データが欠落した状態になる。 これは、 最 悪の場合、 すなわち、 フレーム境界をはさんで前後のブロックが各々 3 8 3サンプル有る場合、 7 6 6サンプルの区間でデ一夕が不完全と なり、 これよりさらに、 前後各々 2 5 6サンプルの区間の復号化がで きない。
そのため、 このようなオーディオビデオ記録再生装置において、 圧 縮ォ一ディォデ一夕の処理単位であるプロヅク期間と、 ビデオフレー ム期間の比率が整数関係に無いようなシステムが提案されている。 第 1 7図は、 このようなシステムの符号化装置 1 0 0の構成例を示し、 第 1 8図は、 復号化装置 2 0 0の構成例を示す。
第 1 7図において、 オーディオ信号 1 0 1は、 48 kH zでサンプ リングされたディジタル信号である。 以下、 サンプリング周期 2 0. 8 s e cを Tとする。 このオーディオ信号 1 0 1が MP E Gレイヤ 一 Iの符号化を行なう MP E G符号化回路 1 05のオーディオ信号入 力端に供給される。
プロヅクパルス 1 02は、 3 84 T毎にァクティプになるパルス信 号であり、 MP E G符号化回路 1 0 5の一方の入力端、 および位相比 較回路 1 0 6の一方の入力端に共に供給される。 入力フレームパルス 1 0 3は、 フレーム周波数 2 9. 9 7 H zをサンプリング周波数 4 8 kH zに同期させた周期、 すなわち 1 6 0 1 Tまたは 1 6 02 T毎に ァクティプになるパルス信号である。 この入カフレームパルス 1 0 3 が位相比較回路 1 0 6の他方の入力端に供給される。 符号フレームパ ルス 1 04は、 フレーム単位でこの符号化装置より出力される符号列 1 0 9の出力位相を示す信号で、 やはり 1 6 0 1 Tまたは 1 6 0 2 T 毎にァクティブになるパルス信号である。 この符号フレームパルス 1 04がメモリ回路 1 07に供給される。
符号化装置 1 00において、 MP E G符号化装置 1 0 5に供給され たオーディオ信号 1 0 1が MP E G符号列に変換され、 メモリ回路 1 0 7に順次書き込まれる。 一方、 位相比較器 1 0 6に供給されたプロ ックパルス 1 0 2と入力フレームパルス 1 0 3が位相比較され、 各フ レーム単位の先頭のオーディオ符号化プロックを示す情報および先頭 ブロックのフレーム境界からのオフセヅ ト量 （位相差） を表す情報が 出力される。 このフレームの先頭プロヅクを示す情報がメモリ回路 1 0 7に書き込まれ、 また、 オフセッ ト量を示す情報がオフセッ ト付加 回路 1 0 8に供給される。
M P E G符号化回路 1 ◦ 5に供給された入力オーディオ信号 1 0 1 は、 共に供給されるプロヅクパルス 1 0 2のタイ ミングでプ Πヅク単 位に符号化処理がなされ、 メモリ回路 1 0 7およびオフセッ ト付加回 路 1 0 8を介し、 符号列 1 0 9として出力される。 したがって、 ビデ オフレーム単位の記録装置において、 プロヅクパルス 1 0 2の入カフ レームパルス 1 0 3に対する相対位相 （オフセッ ト） を記録しておけ ば、 入出力時のオーディオビデオ相対位相が保存される。 フレーム単 位で記録されているオーディオデータが復号された後出力される際に 、 記録された相対位相が出力基準ビデオフレームに対するオーディオ 出力位相を示しているので、 入出力時のオーディオビデオ相対位相が 保存される。
メモリ回路 1 0 7では、 符号フレームパルス 1 0 4を基準として順 次 M P E G符号列が読み出される。 この読み出された M P E G符号列 がオフセッ ト付加回路 1 0 8に供給され、 オフセッ トが付加され、， 符 号列 1 0 9 として出力される。
第 1 8図に示す復号化装置 2 0 0において、 上述の符号化装置 1 0 0によって生成された符号列 2 0 1がメモリ回路 2 0 5に順次書き込 まれると共に、 オフセッ ト抽出回路 2 0 6に供給される。 このオフセ ッ ト抽出回路 2 0 6で、 符号化装置で付加されたオフセッ ト値が符号 列 2 0 1より取り出され、 位相演算回路 2 0 7の一方の入力端に供給 される。 位相演算回路 2 0 7の他方の入力端には、 出力フレームパルス 2 0 4が供給されている。 位相演算回路 2 0 7において、 符号列 2 0 1か ら取り出されたオフセッ ト値により、 出力フレームパルス 2 0 4を基 準として各フレームの先頭のオーディオ符号化プロヅクの位相を袂め る信号が生成され、 メモリ回路 2 0 5に供給される。 供給されたこの 信号に基づき、 メモリ回路 2 0 5から予め書き込まれた符号列が読み 出され、 M P E G復号化回路 2 0 8に供給される。 M P E G復号化回 路 2 0 8において、 この供給された符号列がオーディオ信号に変換さ れ、 オーディオ信号出力 2 0 9として外部へ出力される。
次に、 オーディオ信号が符号化装置 1 0 0によって符号化され、 符 号化されたオーディオ信号がフレーム単位でスィ ヅチングまたは編集 されたとき、 復号化装置 2 0 0によって、 符号化オーディオ信号が復 号された場合を説明する。
スィヅチングまたは編集された符号列に記録されているオフセッ ト から作成される再生ブロック先頭パルスは、 符号化ブロックがフレー ム単位の途中で分割されているので図 1 9図に示すように 3 8 4 T周 期ではなくなり、 メモリ 2 0 5の読み出し動作が連続ではなくなる。 したがって、 図 1 9図に示すように、 この不連続点では、 データの不 完全なブロック、 若しくはギャップが生じる。 このとき M P E G復号 化装置 2 0 8の出力は、 ノイズを発生する。 そのため、 このような従 来の構成ではミュートが必要となる。
第 2 0図は、 このミュート回路 2 1 0を含んだ復号化装置 2 0 0 ' の構成例を示す。 この復号化装置 2 0 0 ' において、 ミュート回路 2 1 0は、 位相演算回路 2 0 7から供給されるミュート夕イミングを示 す信号によって制御され、 M P E G復号化回路 2 0 8の出力がミュー トされる。 このように、 従来の構成例でもノィズの出力を防ぐことは可能であ るが、 データをミュートする必要があり、 スイッチング点 （編集点） におけるミュートに起因する音質の劣化が発生する問題点があった。 発明の開示
したがって、 この発明の目的は、 デ一夕圧縮されたオーディオデー タを、 ビデオフレーム、 若しくはフィールド単位で再生するような機 器において、 ノイズの無い滑らかなスイッチング （編集） を行なうこ とができるような圧縮オーディオデ一夕編集装置を提供することにあ る。
この発明は、 上述した課題を解決するために、 入力されるオーディ ォ信号を入力されるプロックパルス単位で符号化し、 プロックパルス とビデオ信号のフレームとの位相差情報を検出して符号化された符号 列に付加して出力する符号化手段と、 符号化手段から供給される符号 列から位相差情報からオフセッ ト値を検出して出力し、 かっこのオフ セッ ト値が所定値の範囲外であればリピートパルスを出力するオフセ ヅ ト抽出手段と、 ビデオ信号のフレームパルスとオフセヅ ト抽出手段 から供給されるオフセッ ト値からプロック先頭パルスを出力する位相 演算手段と、 才フセッ ト抽出手段からリピートパルスが供給されたと きは入力される符号列の復号を所定期間停止し、 リピートパルスが供 給されないときは符号列を復号してオーディオ信号として出力する復 号化手段と、 位相演算手段より供給されるプロック先頭パルスの位置 から、 復号化手段からのオーディオ信号の書込みを開始し、 オフセッ ト抽出手段から供給されるリピ一トパルスが入力されるとプロック先 頭パルスの位置からオーディオ信号の書込みは行われず、 ブロック先 頭パルスが入力されるとそのパルスの位置から、 書き込まれたオーデ ィォ信号を読出して出力する第 1の出力系と、 プロック先頭位置から 所定期間第 1の出力系で出力されるオーディオ信号に続くオーディオ 信号を出力する第 2の出力系とからなるメモリ手段と、 メモリ手段か ら供給されるオーディオ信号に対して位相演算手段からのブロッグ先 頭パルスの位置から所定期間クロスフエ一ド処理してオーディオ信号 を出力するクロスフエ一ド処理手段とを備えたことを特徴とする圧縮 データ編集装置である。
また、 この発明は、 上述した課題を解決するために、 入力されるォ 一ディォ信号を入力されるプロックパルス単位で符号化し、 プロヅク パルスとビデオ信号のフレームパルスとの位相差情報を検出して符号 化された符号列に位相差情報を付加して出力する符号化手段と、 符号 化手段から出力される符号列の位相差情報からオフセット値を検出し て出力するオフセヅ ト抽出手段と、 才フセッ ト抽出手段から供給され るオフセッ ト値と、 ビデオ信号のフレ一ムパルスが入力されてフレー ム内のプロック先頭パルスを出力する位相演算手段と、 ビデオ信号の 編集点の位置情報を示すスィツチングパルスを供給するスィツチング 手段と、 スイ ッチングパルスが入力されたときは、 符号化手段から供 給される符号列の復号を所定期間停止し、 スィ ツチングパルスが入力 されないときは入力される符号列を復号してオーディオ信号に変換し て出力する復号化手段と、 位相演算手段から供給されるブロック先頭 パルスが入力されたとき、 パルスの位置から復号化回路から出力され るオーディオ信号の書込みが開始され、 スィッチィング手段から供給 されるスィツチングパルスが供給されたときは、 編集点前の符号列の プロックから編集点後の最初の符号列のプロックの直前まで書込みは 行われず、 ブロック先頭パルスが供給された位置から書き込まれたォ —ディォ信号の読出しを行う第 1の出力系と、 プロック先頭パルスが 入力された位置から所定期間第 1の出力系から出力されるオーディオ 信号に続くオーディオ信号を出力する第 2の出力系からなるメモリ手 段と、 メモリ手段から供給されるオーディオ信号に対して、 位相演算 手段から供給されるプロック先頭パルスの位置から所定期間クロスフ ヱ一ド処理してオーディオ信号を出力するクロスフヱ一ド処理手段を 備えたことを特徴とする圧縮デ一タ編集装置である。
また、 この発明は、 上述した課題を解決するために、 入力されるォ 一ディォ信号を入力されるプロヅクパルス単位で符号化化し、 プロヅ クパルスと入力されるビデオ信号のフレームパルスとの位相差を検出 して位相差情報として符号化された符号列に付加して出力する符号化 手段と、 符号化手段から供給される符号列から位相差情報を検出して オフセット値を検出して出力し、 かつオフセット値が所定値の範囲外 であればリピートパルスを出力するオフセヅ ト抽出手段と、 オフセヅ ト抽出手段から供給されるリピートパルスが入力されたとき、 編集点 を持たない連続したフレームの符号列のブロックが符号化手段から供 給されるときは、 符号列の復号は所定期間停止され、 編集点を持つ不 連続なフレームの符号列のプロックが供給されるときは、 符号列を復 号し、 リピートパルスが入力されないときは、 符号列を復号してォー ディォ信号に変換して出力する復号化手段と、 オフセッ ト抽出手段か ら供給されるオフセッ ト値と、 ビデオ信号のフレームパルスが入力さ れて、 ブロック先頭パルスを出力する位相演算手段と、 位相演算手段 から供給されるプロック先頭パルスと、 オフセッ ト抽出手段から供給 されるリピートパルスが入力されて、 プロック先頭パルスの位置から 復号手段から供給されるオーディオ信号の書込みが行われ、 編集点を 持たない連続したオーディオ信号でかつリピートパルスを供給する符 号列に対応するオーディオ信号は所定期間書込みが行われず、 プロッ ク先頭パルスが入力されるとパルスの位置から書き込まれたオーディ ォ信号を読出して出力する第 1の出力系と、 先頭ブロックパルスの位 置から所定期間第 1の出力系から読み出されたオーディオ信号に続く ォ一ディォ信号を読出して出力する第 2の出力系からなるメモリ手段 と、 メモリ手段から供給されるオーディオ信号が入力されて、 位相演 算手段より供給される先頭プロックパルスの位置から所定期間クロス フエ一ド処理してオーディオ信号を出力するクロスフヱ一ド手段とを 備えたことを特徴とする圧縮データ編集装置である。
上述した構成によれば、 位相調整手段の第 1の出力系統が出力基準 ビデオ信号に対して相対位相情報を補正した位置に復号された信号を 出力し、 位相調整手段の第 2の出力系統が 1フレーム前の出力に続く 復号信号を出力するために、 スイッチング点 （編集点） にクロスフエ 一ドをかけることが可能となり、 滑らかな再生出力を得ることができ ο
図面の簡単な説明
第 1図は、 この発明による復号化装置の構成の一例を示すプロック 図、 第 2図は、 M P E G符号化回路の入出力信号を示す略線図、 第 3 図は、 位相比較回路の動作の説明のための略線図、 第 4図は、 この発 明による符号化装置におけるメモリ回路の動作を示す略線図、 第' 5図 は、 第 1の実施例の復号化装置における、 編集が行なわれていない場 合の各入出力信号の一例を示す略線図、 第 6図は、 第 1の実施例によ る復号化装置におけるメモリ回路の動作を示す略線図、 第 7図は、 符 号列のスイッチング点 （編集点） におけるクロスフヱ一ド処理を示す 略線図、 第 8図は、 オーディオ信号のスイッチングの場合と、 符号列 のスイッチングを復号した場合の出力の比較を示す略線図、 第 9図は 、 第 1の実施例において、 第 5ブロック〜第 1 4ブロックの符号列が スィツチング （編集） により無くなった例を示す略線図、 第 10図は 、 第 2の実施例において、 MPEG (Laye r l) のデータを 52 5 /59. 94方式のビデオフレームに乗せる例を示す略線図、 第 1 1図は、 第 2の実施例において、 第 6ブロック〜第 8ブロック、 '第 5 ブロックおよび第 9ブロックの一部の符号列がスイッチング （編集） により無くなった例を示す図、 第 12図は、 第 3の実施例において、 MPEG (L a y e r II) のデ一夕を 625/ 50方式のビデオフレ ームに乗せる例を示す略線図、 第 13図は、 第 3の実施例において、 第 3プロック、 および第 2プロヅクと第 4プロヅクの一部の符号列が スィツチング （編集） により無くなった例を示す略線図、 第 14図は 、 第 4の実施例において、 連続したフレームを復号する場合の、 復号 化装置における各入出力信号の例を示す略線図、 第 15図は、 第 4の 実施例において、 不連続なフレームの先頭にリピ一トフラグが立って いない場合の、 復号化装置における各入出力信号の例を示す略線図、 第 1 6図は、 第 4の実施例において、 不連続なフレームの先頭にリピ 一トフラグが立っている場合の、 復号化装置における各入出力信号の 例を示す略線図、 第 17図は、 ブロック期間とビデオフレーム期間の 比率が整数閧係に無いようなシステムにおける符号化装置の構成の例 を示すプロック図、 第 18図は、 従来例における復号化装置の構成の 例を示すブロック図、 第 1 9図は、 フレームスィヅチングされた符号 列の処理の例を示す略線図、 第 20図は、 従来技術による、 ミュート 回路を含んだ復号化装置の例を示すプロック図である。
発明を実施するための最良の形態
以下、 この発明の第 1の実施例について、 図面を参照しながら説明 する。 第 1図は、 この実施例による復号化装置の構成の一例を示す。 この第 1の実施例においては、 MPEG (Laye r I) のデ一夕 を 5 2 5ノ 5 9 . 9 4方式のビデオフレームに乗せる例について説明 する。 また、 この復号化装置に対応する符号化装置としては、 例えば 第 1 7図に示した、 従来技術による符号化装置 1 0 0が適用される。 この実施例による復号化装置は、 上述した従来例による復号化装置 2 0 0の構成に対し、 M P E G復号化回路およびメモリ回路の位置が入 れ換えられている。 符号列が復号されオーディオ信号へと変換された 後、 メモリ回路において出力オフセッ ト処理が行なわれ、 クロスフヱ 一ド回路においてクロスフエ一ド処理が行なわれる。
第 1 7図に示す符号化装置 1 0 0において、 M P E G符号化回路 1 0 5にオーディオ信号 1 0 1が供給される。 また、 この M P E G符号 化装置 1 0 5には、 プロヅクパルス 1 0 2も共に供給されている。 こ れらの信号が供給された M P E G符号化回路 1 0 5によって、 第 2図 に示すように、 プロヅクパルス 1 0 2で示される 3 8 4 T区間のォー ディォ信号 1 0 1に対応するデータである M P E G符号列が一定量の 遅延で出力される。 この出力は、 メモリ回路 1 0 7に供給される。 な お、 このメモリ回路 1 0 7は、 デ一夕が書き込まれるメモリと、 この メモリに対する書込みおよび読み出しを制御するための回路が含まれ る。
位相比較回路 1 0 6には、 上述のプロックパルス 1 0 2および入力 フレームパルス 1 0 3が供給され、 これらの信号により、 そのフレー ムに属する先頭ブロックが決定される。 すなわち、 第 3図に示すよう に、 フレームパルスの位置から前後に幅 3 8 4 Tの区間が設定される 。 設定されたこの区間内には、 必ず 1つのブロックパルスが存在する ので、 このパルスから始まるブロヅクが当該フレームの先頭ブロヅク とされる。 このフレームの中の先頭プロヅクを示す信号がメモリ回路 1 0 7に供給される。 .
0 また、 このプロヅクパルスの位置がオフセヅ ト値として出力される
。 幅 384 Tの区間は、 フレームパルスを中心として、 例えば、 一 1 92 Tから + 19 1 Tまで、 あるいは一 35 1 Tから + 32 Tまでが 設定される。 第 3図の例では、 一 351 Tから + 32 Tまでが設定さ れている。 このオフセッ ト値は、 オフセッ ト付加回路 108に供給さ れ 。
メモリ回路 107には、 MP EG符号化回路 105から出力される オーディオ信号に対応するデ一夕 （符号列） が書き込まれ、 共に供給 されている位相比較回路 106から出力される先頭ブロックを示す信 号に基づき、 1フレーム当たり 5ブロックが読み出される。 したがつ て、 メモリ回路 107から出力されるオーディオデータの符号列は、 1フレームあたりサンプル長 320で割りふられている。 第 4図は、 このプロヅクの読み出しのタイ ミングを示す。 第 4図に示されている ようにメモリ回路 107からの出力は、 符号列 320 T単位で割りふ られているので、 符号フレームパルス 1 04に同期している。 しかし 、 メモリ回路 107から出力される際に、 MPEG符号化回路 105 で符号化された符号列に対して、 1フレームには 4プロヅク入るが、 5ブロック目は、 位相比較回路 106から出力される先頭ブロックパ ルスにより次のフレームの先頭ブロックになり、 2回出力される可能 性もある。 つまり、 プロヅクが順次読み出される場合と、 第 4図の第 5プロックや第 14ブロヅクのように、 フレームの境界で同じプロヅ クが 2回繰り返して読み出される場合とがある。 また、 メモリ回路 1 07には、 符号フレームパルス 1 04も供給されていて、 読み出し開 始の位相は、 この符号フレームパルス 104で与えられる。 メモリ回 路 107から読み出されたこのデータは、 オフセッ ト付加回路 108 に供給され、 各フレームの先頭あるいは各ブロックの先頭に、 位相比
1 較回路 1 0 6から供給されたオフセッ トが付加される。
第 1図に示す復号化装置 1において、 符号列 1 0が M P E G復号化 回路 2およびオフセッ ト抽出回路 3に共に供給される。 また、 このォ フセヅ ト抽出回路 3には、 プロヅクパルス 1 1および符号フレームパ ルス 1 2も共に供給されている。 このオフセット抽出回路 3の一方の 出力は、 M P E G復号化回路 2およびメモリ回路 4に共に供給される 。 オフセット抽出回路 3の他方の出力は、 位相演算回路 5の一方の入 力端に供給される。 この位相演算回路 5の他方の入力端には、 出カフ レームパルス 1 3が供給される。 また、 この位相演算回路 5の一方の 出力がメモリ回路 4に供給され、 他方の出力がクロスフェード回路 6 に供給される。 M P E G復号化回路 2の出力がメモリ回路 4に供給さ れる。 メモリ回路 4のメモリ出力 Aおよびメモリ出力 Bは、 クロスフ ェ一ド回路 6に夫々供給される。 クロスフェード回路 6の出力は、 ォ —ディォ信号 1 4として外部に出力される。
M P E G復号化回路 2に供給された符号列 1 0は、 一定量、 遅延し た後オーディオ信号 （復号出力） に変換する復号化がなされる。 第 5 図は、 この復号化装置 1における、 編集が行なわれていない各入出力 信号の一例を示す。 この復号化の際に、 繰り返されるブロックに対し ては、 M P E G復号化回路 2の動作が一時停止される。 この例では、 第 5ブロックが符号化の際に繰り返して記録されている。 これは、 ォ フセッ ト抽出回路 3で得られるオフセッ ト値から検出が可能である。 すなわち、 この抽出されたオフセッ ト値が所定値、 この例では ± 3 2 の範囲外であれば、 オフセッ ト抽出回路 3によってリピートパルスが 出力され、 このリピートパルスが M P E G復号化回路 2に供給される 。
このリピートパルスが供給されると、 M P E G復号化回路 2では このパルスに対応する、 2回目に記録された符号ブロックである第 5 プロックにおいて復号化処理が一時停止され、 次の第 6プロックが入 力されてから処理が開始される。
この復号化処理の一時停止は、 プロックの境界付近のデ一夕が繰り 返し記録されているときの復号化処理に対して必要な処理となる。 M P E G復号化回路 2において、 供給された符号列 1 0は、 M P E G復 号化回路 2内の例えば、 5 1 2タップの合成フィル夕に供給されォー ディォ信号に変換される。 このため、 隣合ったブロックの境界付近の 2 5 6サンプルのデータは互いに影響を受け、 その結果、 正しい.ォー ディォ信号が出力される。
したがって、 上述したように、 繰り返し記録された符号列 1 0の第 5プロックが M P E G復号化回路 2内の合成フィル夕に供給されてい る間、 復号化処理を一時停止することによって、 見かけ上第 5プロッ クと第 6プロックの符号列データが連続に処理され、 境界付近のデ一 夕が正しく復号される。
符号列の復号の一時停止以外に境界付近のデータが正しく復号され るために、 入力符号列の入れ替えと出力オーディオ信号の削除を組み 合わせて行なう方法がある。 オフセヅ ト抽出回路 3によってリピート パルスが出力される （リピートフラグが立った） ブロックにおいて復 号を停止せずに行ない、 これに対応する出力オーディオ信号を無効デ —タとして後段のメモリ回路 4において削除する。 さらに、 オフセッ ト抽出回路 3によってリピートパルスが出力されるプロヅクの次のブ 口ックにおいて入力される符号列をオフセヅ ト抽出回路 3によってリ ピートパルスが出力されるプロックの符号列と入れ換えて復号処理を 行なう。
第 5図において、 このときの処理について説明する。 第 3ブロック 、 第 4ブロック、 第 5ブロックの符号列に対応して復号出力の第 5ブ ロックが MP E G復号化回路 2 1に入力される。 次に、 リピートフラ グが立った符号列 （符号列の 'R， が付された第 5ブロック。 第 5 c R' ブロックと称する） が MP E G復号回路 2に入力される。 このと き、 処理を停止せずに第 5 CR5 ブロックに対応する復号出力の第 5 ， プロヅク （図示しない） が MP E G復号化回路 2から出力される。 さらに、 符号列 6が MP E G復号化回路 2に入力されたとき、 符号 列の第 5 fR5 ブロックと第 6ブロックとを入れ換えて復号化処理が 行なわれ、 対応する復号出力の第 6ブロックが出力される。 後段のメ モリ回路 4において、 リピートフラグが立った復号出力の第 5， プロ ヅクの上に再度復号出力の第 6プロヅクを書き込むことによって、 符 号列の復号の一時停止と同様に第 5プロックおよび第 6プロックの符 号列データが連続的に処理され、 境界付近のデ一夕が正しく復号され る。
MP E G復号化回路 2の出力は、 第 5図の復号出力に示すように、 ブロックの欠けたものとなる。 この出力は、 メモリ回路 4に供給され る。 また、 オフセッ ト抽出回路 3の出力は、 出力フレームパルス 1 3 と共に位相演算回路 5にも供給される。 位相演算回路 5では、 これら の信号に基づき演算が行なわれ、 符号フレームパルス 1 2から MP E G復号化回路 2の処理に要するディ レイを受けた書き込み先頭パルス が出力される。 この出力された先頭パルスおよびオフセッ ト抽出回路 3から検出されたリピ一トパルスがメモリ回路 4に供給される。
MP E G復号化回路 2およびメモリ回路 4の書き込み処理の処理ク ロックは、 1フレーム当たり 5ブロヅク分のデ一夕 （ 1 9 20サンプ ル） を扱う周波数であり、 また、 メモリ回路 4の読み出し処理の処理
4 クロックは、 1フレーム当たり 1 6 0 2 / 1 6 0 1サンプル分のデー 夕を扱う周波数である。 メモリ回路 4は、 タイムベース機能を有して おり、 それにより、 断続的に供給される復号出力が連続するオーディ ォ信号に時間軸変換される。
メモリ回路 4においては、 位相演算回路 5より供給された書き込み 先頭パルスの位置から、 復号出力のメモリ回路 4への書き込みが開始 される。 ただし、 このとき、 リピートパルスをメモリ回路 4に供給す るフレームでは、 先頭プロヅクの書き込みが行なわれず、 2番目のブ ロックから書き込みが行なわれる。 したがって、 第 5図の復号出力に 示されるブロックだけがメモリ回路 4のメモリに書き込まれる。 ' このメモリ回路 4のメモリからの読み出しは、 読み出し Aおよび読 み出し Bの 2系統にわかれ、 これら読み出されたデータは、 それそれ メモリ出力 Aおよびメモリ出力 Bとして出力される。 読み出し Aは、 出カフレームパルスおよびオフセヅ トから作成されるプロヅク先頭パ ルスの位置から読み出しが行なわれ、 ブロック毎に先頭読み出しアド レスが補正される。 連続信号においては、 補正された読み出しァドレ スは補正前のものと違わず、 連続したデータが読み出され、 メモリ出 力 Aとして出力される。 第 6図は、 この復号化装置 1のメモリ回路 4 の動作を示す。 このように、 オフセッ 卜によって、 先頭のブロックの ァドレスが補正され、 出力される。
読み出し Bからは、 プロヅク先頭の位置からクロスフェード期間 （ 第 5図の例では、 5 1 2サンプル) だけメモリ出力が得られる。 第 5 図の例では、 メモリ出力 Aおよびメモリ出力 Bは、 同じデータとなる 。 これらメモリ出力 A、 Bは、 クロスフエ一ド回路 6に供給され、 ク ロスフェード処理された後オーディオ信号 1 4として出力される。 こ の出力されたオーディオ信号 1 4は、 第 6図の例では、 メモリ出力 A と同じデ一夕となる。
第 7図は、 符号列のスイ ッチング点 （編集点） におけるクロスフエ —ド処理を示す。 この例では、 第 5ブロック〜第 9プロヅクの符号列 がスィ ヅチング （編集） により無くなつている。 第 5図の例において 説明したように、 繰り返し記録された符号列のブロックが M P E G復 号化回路内にあるプロックが合成フィルタに供給されている間、 入力 される符号列の復号化処理が一時停止される。 それにより、 M P E G 復号化回路 2の出力は、 第 7図の復号出力に示すようにプロックの欠 けたものとなり、 この信号がメモリ回路 4に供給される。
第 5図と同様に、 書き込み先頭パルスの位置から、 復号出力のメモ リ回路 4のメモリへの書き込みが開始される。 このとき、 リピ一トフ ラグが立っているフレームでは、 先頭プロヅクの書き込みが行なわれ ず、 2番目のプロックから書き込みが行なわれる。 したがって、 第 7 図の復号出力に示されるブロックだけがメモリに取り込まれる。 第 7図に示す例で、 スイッチング点 (編集点) において符号プロヅ ク 5と 1 0が隣合っている。 オーディオ信号においては、 このような スィ ツチング点の信号は、 高調波成分を含んだポップノイズとなるが 、 M P E Gに代表されるサブバンド符号/復号においては、 復号の過 程の合成フィル夕の効果によって、 隣合ったプロックの境界付近のサ ンプルが互いに影響し、 滑らかな出力が得られる。
第 8図は、 オーディオ信号のスイッチングの場合と、 符号列のスィ ツチングを復号した場合の出力の比較を示す。 第 8図 Aおよび第 8図 Bは、 近接した周波数のオーディオ信号の、 スイ ッチング点における 信号を示す。 ここで、 第 8図 Aは、 一般のオーディオ信号におけるス イ ッチング点の信号を示し、 第 8図 Bは、 サブバンド復号におけるス ィ ヅチング点における信号を示す。 図中で、 横軸の 0の位置がスイ ツ チング点である。 また、 第 8図 Cおよび第 8図 Dは、 スイッチングさ れる 2つの信号の周波数の差が大きい場合について示す。 これも同様 にして、 第 8図 Cは、 一般のオーディオ信号におけるスイッチング点 の信号を示し、 第 8図 Dは、 サブバンド復号におけるスイッチング点 における信号を示す。 このように、 M P E Gの合成フィル夕の効果に より、 スイッチング点 （編集点） においてもノイズ成分を含まない滑 らかな出力が得られる。
書き込み先頭パルスの位置からメモリに書き込まれた復号出力に対 するメモリからの読み出しは、 読み出し Aおよび読み出し； Bの 2系統 にわかれる。 読み出し Aは、 出力フレームパルスとオフセヅ トから作 成されるプロック先頭パルスの位置から読み出しが行なわれ、 毎プロ ヅクで先頭読み出しアドレスが補正される。 したがって、 第 7図に示 すように、 スイッチング (編集) により切り替わったブロックに対応 するプロック先頭パルスの位置で、 第 5プロックの後半の位置部分が 欠落し、 第 1 0プロックの先頭が続いて出力される。
読み出し Bは、 プロヅク先頭の位置からクロスフェード期間 （第 7 図の例では、 5 1 2サンプル） だけ復号出力が出力される。 ブロック 先頭の直前に読み出し Aで読み出されたデ一夕に続くデータが読み出 される。 すなわち、 読み出し Aにおいて欠落した第 5プロヅクの後半 部分の復号出力が読み出され、 続いて第 1 0ブロックの先頭の復号出 力が読み出され、 メモリ出力 Bとして出力される。
これらメモリ出力 A、 Bは、 共にクロスフヱ一ド回路 6に供給され 、 クロスフヱ一ド処理され、 オーディオ信号 1 4として出力される。 このクロスフエ一ド処理は、 ブロヅク先頭パルスの位置から、 クロス フエ一ド期間 （第 7図の例では、 5 1 2サンプル） 行なわれる。 スィ ヅチング点 （編集点） 以外では、 メモリ出力 Aおよびメモリ出力 Bは
7 、 同一信号となるので、 ク πスフヱ一ド処理によって出力信号が変化 しない。 このクロスフエ一ド処理された出力信号を、 第 7図中で a d e出力として示す。 ここでは、 クロスフェードゲインが斜め線で 示されている。 メモリ出力 A、 B共に、 合成フィル夕効果のため滑ら かな信号であるから、 クロスフェード出力としてノイズの無い出力を 得ることができる。
第 9図は、 第 5ブロック〜第 1 4プロヅクの符号列がスィ ヅチング (編集） により無くなった例を示す。 この場合も、 上述した第 7図と 同様の処理を行なうことにより、 クロスフェード出力としてノイズの 無い出力が得られる。
次に、 この発明の第 2の実施例を、 図面を参照しながら説明する。 第 1 0図、 第 1 1図は、 第 1の実施例と同様、 M P E G ( L a y e r I ) のデ一夕を 5 2 5 / 5 9 . 9 4方式のビデオフレームに乗せる例 を示す。 この例においては、 オーディオ信号が符号化された後、 1フ レーム当たり 1 6 0 1あるいは 1 6 0 2サンプル分のデータが記録さ れる。 また、 オフセヅ ト値がフレーム毎に記録される。 符号フレーム パルスと符号列が同位相のとき、 このオフセット値は、 0となる。 符 号列がフレームパルスと同位相にない時、 フレームパルスの直後のブ 口ヅクの先頭とフレームパルスの間隔がオフセヅ 卜とされる。 第 1 0 図において 1番目のフレ一ムのオフセッ トが 0であり、 2番目のフレ —ムのオフセヅ トが図の矢印で示された区間となる。
この実施例においても、 上述した第 1の実施例と同様、 第 1図に示 す復号化装置 1が用いられる。 M P E G復号化回路 2に供給された符 号列 1 0は、 一定量遅延した後オーディオ信号 （復号出力） に変換さ れ、 メモリ回路 4に供給される。 このメモリ回路 4には、 オフセッ ト 抽出回路 3により、 符号フレームパルス 1 2がディ レイされて生成さ れた書き込み先頭パルスも供給される。 この供給された書込み先頭パ ルスの位置から、 復号出力のメモリ回路 4のメモリへの書き込みが開 始される。
メモリ回路 4のメモリからの読み出しは、 読み出し Aおよび読み出 し Bの 2系統にわかれる。 メモリ回路 4に書込まれた復号出力の読み 出し Aからの読み出しは、 出力フレームパルス 1 3およびオフセヅ ト 抽出回路 3によって抽出されたオフセヅ トから、 位相演算回路 5によ つて作成されるプロヅク先頭パルスの位置から行なわれ、 プロヅク每 に先頭読み出しアドレスが補正される。 連続信号においては、 補正さ れた読み出しアドレスは補正前のものと違わず、 連続したデ一夕が読 み出され、 メモリ出力 Aとして出力される。 編集装置内のスィッチン グ装置 1 5により、 どのプロヅクでスィ ツチングしたかを示すスィ ッ チングフラグ信号 1 6が、 復号化装置 1の M P E G復号化回路 2、 メ モリ回路 4及びクロスフエ一ド回路 6に供給されているのでスィヅチ ング （編集） によって編集されるプロックには、 スイッチングフラグ を立てることが可能となる。 読み出し Bは、 メモリ回路 4でこのスィ ヅチンダフラグが検出されない場合、 0を出力する。 このように、 ス ィツチングフラグが検出されない場合、 クロスフエ一ド回路 6ではク ロスフエ一ド処理は行なわれず、 メモリ出力 Aがそのままオーディォ 信号 1 4として出力される。
第 1 1図は、 符号列 1 0のスイッチング点 (編集点) のクロスフエ —ド処理を示す。 この例においては、 第 1 1図に示すように、 第 6プ ロック〜第 8プロヅクおよび第 5プロック、 第 9プロヅクの一部の符 号列がスイッチング （編集） により無くなつている。
この場合にも、 上述した第 1の実施例と同様、 復号化処理の一時停 止が行なわれる。 M P E G復号化回路 2でスィ ヅチングフラグが検出
9 された場合、 切替えられる前の、 即ち編集点前のフレームの、 この例 では、 4番目のプロック以降から切替えられた後の最初のプロヅクが 合成フィル夕に供給されるまでの間、 復号化処理が一時停止される。 それにより、 M P E G復号化回路 2の出力は、 第 1 1図の復号出力に 示すように、 ブロックの欠けたものとなり、 メモリ回路 4に供給され る。
第 1 0図と同様、 メモリ回路 4に供給される書き込み先頭パルスの 位置から、 復号出力のメモリ回路 4のメモリへの書き込みが開始され る。 このとき、 スィヅチングフラグが立っているフレームでは、 切替 えられる前のフレームの、 この例においては、 4番目のブロック以降 から切替えられた後の最初のプロックの直前までの書き込みが行なわ れず、 切替えられた後の最初のプロックの先頭から書き込みが行なわ れる。 したがって、 第 1 1図の復号出力に示されるブロックだけがメ モリ回路 4のメモリに書き込まれる。
メモリ回路 4のメモリからの読み出しは、 読み出し Aおよび読み出 し Bの 2系統にわかれる。 メモリ回路 4に書き込まれた復号出力の読 み出し Aからの読み出しは、 出力フレームパルス 1 3とオフセッ ト抽 出回路 3で抽出されたオフセッ トから、 位相演算回路 5によって作成 される、 プロック先頭パルスの位置から行なわれ、 ブロック每に先頭 読み出しアドレスが補正される。 したがって、 第 1 1図に示すように 、 スイ ッチング （編集） により切替わったブロックに対応するブロヅ ク先頭パルスの位置で、 第 1 1プロックの後半の位置部分が欠落し、 第 1 0プロヅクの先頭が続いて出力される。 さらに、 スイッチングフ ラグが立ったときには、 出カフレームパルス 1 3を 3プロヅク分ディ レイさせた出力フレームパルス， の位置から切替わり、 直後のブロヅ クが出力される。 この結果、 メモリからの読み出し Aは、 第 1 0図に 示すメモリ出力 Aとして出力される。
第 1 1図に示すように、 スィヅチング点 （編集点） において、 符号 プロヅクである第 3プロヅクと第 10プロックが隣合っている。 この ときにも、 上述した第 1の実施例と同様、 復号の過程の合成フィル夕 の効果によって、 隣合ったブロックの境界付近のサンプルが互いに影 響し、 滑らかな出力が得られる。
読み出し Bは、 ブロック先頭の位置からクロスフエ一ド期間 （第 1 1図の例では、 5 12サンプル） だけ出力される。 ブロック先頭の直 前に、 読み出し Aで読み出されたデータに続くデ一夕が読み出される 。 すなわち、 読み出し Aにおいて欠落した第 1 1プロヅクの後半部分 が読み出され、 続いて第 12プロックの先頭が出力される。
メモリ出力 A、 Bは、 クロスフェード回路 6に供給され、 クロスフ エード処理され、 オーディオ信号 14として出力される。 このクロス フエ一ド処理は、 スィ ツチングフラグが検出されたときのみ行なわれ 、 位相演算回路 5からクロスフェード回路 6に供給されたブロック先 頭パルスの位置からクロスフヱ一ド期間 （図の例では、 5 12サンプ ル） 行なわれる。 この、 クロスフヱ一ド処理が行なわれたオーディオ 信号 14が、 X f a d e出力として第 1 1図に示されている。 クロス フヱ一ドゲインは斜め線で示されている。 メモリ出力 A、 B共に合成 フィルタ効果で滑らかな信号であるから、 クロスフェード出力として ノィズのない出力を得ることができる。
次に、 この発明の第 3の実施例を、 図面を参照しながら説明する。 第 12図、 第 1 3図には、 MPEG (Laye rll) のデータを 62 5/5◦方式のビデオフレームに乗せる例が示されている。 この L a ye rllにおいては、 ブロック長が 1 1 52サンプルとなる。
この例においては、 オーディオ信号が符号化された後、 1フレーム 当たり 1 9 2 0サンプル分のデータが記録されて、 オフセッ ト値が毎 フレーム記録される。 符号フレームパルスと符号列が同位相の時オフ セヅ ト値は 0となる。 符号列がフレームパルスと同位相に無いとき、 フレームパルスの直後のブロヅクの先頭とフレームパルスの間隔がォ フセヅ トとされる。 第 1 2図において、 1番目のフレームのオフセヅ トは、 0であって、 2番目のフレームのオフセヅ トは、 図中に矢印で 示された区間となる。
この実施例においても、 上述した第 1および第 2の実施例と同様、 第 1図に示す復号化装置 1が用いられる。 M P E G復号化回路 2に供 給された符号列 1 0は、 一定量遅延した後オーディオ信号 （復号出力 ) に変換され、 メモリ回路 4に供給される。 このメモリ回路 4には、 オフセッ ト抽出回路 3により、 符号フレームパルス 1 2がディ レイさ れて生成された書き込み先頭パルスも供給される。 この供給された書 込み先頭パルスの位置から、 復号出力のメモリ回路 4のメモリへの書 き込みが開始される。
メモリ回路 4のメモリからの読み出しは、 読み出し Aおよび読み出 し Bの 2系統にわかれる。 メモリ回路 4に書込まれた復号出力の読み 出し Aからの読み出しは、 出カフレームパルス 1 3およびオフセヅ ト 抽出回路 3によって抽出されたオフセッ トから、 位相演算回路 5によ つて作成されるブロック先頭パルスの位置から行なわれ、 毎ブロック で先頭読み出しアドレスが補正される。 連続信号においては、 補正さ れた読み出しァドレスは補正前のものと違わず、 連続したデータが読 み出され、 メモリ出力 Aとして出力される。 編集装置内のスィ ッチン グ装置 1 5により、 どのプロックでスィツチングしたかを示すスィッ チングフラグ信号 1 6が、 復号化装置 1の M P E G復号化回路 2、 メ モリ回路 4及びクロスフエ一ド回路 6に供給されているのでスィ ヅチ ング （編集） によって編集されるブロックには、 スィ ヅチングフラグ を立てることが可能となる。 読み出し Bは、 メモリ回路 4でこのスィ ヅチンダフラグが検出されない場合、 0が出力される。 このように、 スィヅチングフラグが検出されない場合、 クロスフェード回路 6では クロスフェード処理は行なわれず、 読み出し Aがそのままオーディオ 信号 1 4として出力される。
第 1 3図は、 符号列 1 0のスイ ッチング点 （編集点） のクロスフエ ード処理を示す。 この例においては、 第 1 3図に示すように、 第 3ブ 口ヅク、 および第 2プロックと第 4プロヅクの一部の符号列がスイ ツ チング （編集） により無くなつている。
この場合にも、 上述した第 1、 第 2の実施例と同様、 復号化処理の 一時停止が行なわれる。 M P E G復号化回路 2でスィ ヅチンダフラグ が検出された場合、 切替えられる前の即ち、 編集点前のフレームの、 この例においては、 4番目のブロック以降から切替えられた後の最初 のブロックが合成フィルタに供給されるまでの間、 復号化処理が一時 停止されることによって、 M P E G復号化回路 2の出力は、 第 1 5図 の復号出力に示すように、 プロックの欠けたものとなり、 メモリ回路 4に入力される。
第 1 2図と同様に、 書き込み先頭パルスの位置から復号出力のメモ リへの書き込みが開始される。 このとき、 スイ ッチングフラグが立つ ているフレームでは、 切替えられる前のフレームの 2番目のブロック 以降から切替えられた後の最初のプロックの直前までの書き込みが行 なわれず、 1番目のブロックから書き込みが行なわれる。 したがって 、 第 1 3図の復号出力に示されるプロヅクだけがメモリ回路 4のメモ リに取り込まれる。
メモリ回路 4のメモリからの読み出しは、 読み出し Aおよび読み出 し Bの 2系統にわかれる。 メモリ回路に書込まれた復号出力の読み出 し Aからの読み出しは、 出カフレームパルス 1 3とオフセヅ ト抽出回 路 3で抽出されたオフセッ トから、 位相演算回路 5によって作成され る、 ブロック先頭パルスの位置から行なわれ、 プロック毎に先頭読み 出しアドレスが補正される。 したがって、 第 1 3図に示すように、 ス ィ ツチング （編集） により切替わったプロヅクに対応するプロヅク先 頭パルスの位置で、 第 6ブロックの後半の位置部分が欠落し、 第 5ブ ロックの先頭が続いて出力される。 さらに、 スイッチングフラグが立 つたときには、 出カフレームパルス 1 3を 1プロヅク分ディ レイさせ た出力フレームパルス， の位置から切替わり、 直後のブロックが出力 される。 この結果、 メモリからの読み出し Aは、 第 1 3図に示すメモ リ出力 Aとして出力される。
第 1 3図に示すように、 スィヅチング点 (編集点) において、 符号 プロックである第 1プロヅクと第 5プロヅクが隣合っている。 このと きにも、 上述した第 1および第 2の実施例と同様、 復号の過程の合成 フィル夕の効果によって、 隣合ったプロヅクの境界付近のサンプルが 互いに影響し、 滑らかな出力が得られる。
読み出し Bは、 ブロック先頭の位置から、 クロスフェード期間 （第 1 3図の例では、 5 1 2サンプル） だけ出力される。 ブロック先頭の 直前に、 読み出し Aで読み出されたデ一夕に続くデータが読み出され る。 すなわち、 読み出し Aにおいて欠落したブロック 6の後半部分が 読み出され、 メモリ出力 Bとして出力される。
メモリ出力 A、 Bは、 クロスフェード回路 6に供給され、 クロスフ ヱ一ド処理され、 オーディオ信号 1 4として出力される。 このクロス フェード処理は、 スイッチングフラグが検出されたときのみ行なわれ 、 位相演算回路 5からクロスフヱ一ド回路 6に供給されたプロック先 頭パルスの位置からクロスフェード期間 （図の例では、 5 1 2サンプ ル） 行なわれる。 この、 クロスフェード処理が行なわれたオーディオ 信号 1 4が、 X f a d e出力として第 1 3図に示されている。 クロス フェードゲインは、 斜め線で示されている。 メモリ出力 A、 B共に合 成フィル夕効果で滑らかな信号であるから、 クロスフエ一ド出力とし てノィズのない出力を得ることができる。
次に、 この発明の第 4の実施例を、 図面を参照しながら説明する。 この実施例においても、 上述した第 1の実施例と同様、 第 1図に示す 復号化装置 1が用いられる。 この例では、 連続したフレームが復号さ れる場合は、 上述した第 1、 第 2、 および第 3の実施例と同様、 復号 化動作が一時停止される。 これに対して、 不連続なフレームを復号す る場合については、 復号化動作の一時停止は行なわれない。 また、 不 連続なフレームの先頭にリピートフラグが立っていない場合の処理も 、 上述の第 1、 第 2、 および第 3の実施例と同様のものとなる。 しか し、 この実施例においては、 不連続なフレームの先頭にリピートフラ グが立っている場合の処理がこれらの例と異なり、 復号化動作の一時 停止を行なわない。 第 1 4図、 第 1 5図、 および第 1 6図は、 それそ れ、 これらの場合の復号化装置 1において、 MP E G (L a y e r I ) のデータを 5 2 5/5 9. 9 4方式のビデオフレームに乗せた場 合の、 各入出力信号の一例を示す。
MP E G復号化回路 2に供給された符号列 1 0は、 一定量遅延され た後、 オーディオ信号 （復号出力） に変換される。 この復号化の際に 、 第 1 6図に示すように、 連続したフレームでは繰り返されるブロッ クに対しては、 動作を一時停止し、 不連続なフレームの先頭では常に 復号化を行なう。
第 1 6図において、 第 1ブロック、 第 1 4ブロック、 第 1 8プロッ ク、 および第 2 2ブロックは、 符号化のときに繰り返して記録されて いる。 これはオフセッ ト値から検出が可能であり、 このオフセッ ト値 が所定値の範囲外、 この例では、 符号化の際位相比較回路 1 0 6でフ レームパルスを中心にして 3 8 4 Tの区間、 一 3 5 1 Tから + 3' 2 T まで設定されているので、 ± 3 2の範囲外であれば、 オフセッ ト抽出 回路 3から、 検出されたリピートパルスが M P E G復号化回路 2に供 給される。 また、 このとき、 リピートフラグが立てられる。 M P E G 復号化回路 2において、 このパルスに対応する 2回目に記録された符 号プロックが連続したフレームであれば、 復号化処理が一時停止され 、 次のブロックが入力されてから処理が開始される。 第 1 6図の例で は、 第 1ブロック、 第 1 8ブロック、 および第 2 2ブロックの復号化 処理が一時停止される。 これに対し、 不連続なフレームの先頭ブロヅ クである第 1 4プロックは、 復号化処理が停止されずに実行される。 連続したフレームの先頭にリピートフラグが立っている場合、 復号 化処理が一時停止される。 この一時停止の処理は、 プロックの境界付 近のデータの復号処理に対して必要な処理となる。 M P E G復号化回 路 2において、 供給された符号列 1 0は、 例えば、 M P E G復号化回 路 2内にある 5 1 2タップの合成フィル夕に供給され、 オーディオ信 号に変換される。 このため、 隣合ったブロックの境界付近の 2 5 6サ ンプルのデ一夕は互いに影響を受け、 その結果、 正しいオーディオ信 号が出力される。
したがって、 上述したように、 繰り返し記録された符号列のブロッ クが合成フィル夕に供給されている間、 復号化処理が一時停止される ことによって、 見かけ上、 ブロックおよびブロックの符号列データが 連続に処理され、 境界付近のデ一夕が正しく復号される。 M P E G復号化回路 2の出力は、 第 1 6図の復号出力に示すように 、 プロヅクの欠けたものとなる。 この出力は、 メモリ回路 4に供給さ れる。 また、 オフセッ ト抽出回路 3の出力は、 出力フレームパルス 1 3 と共に位相演算回路 5にも供給される。 位相演算回路 5では、 これ らの信号に基づき演算が行なわれ、 符号フレームパルス 1 2から M P E G復号化回路 2の処理に要するディ レイを受けた書き込み先頭パル スが出力される。 この出力された先頭パルスおよびオフセッ ト抽出回 路 3から検出されたリピ一トパルスがメモリ回路 4に供給される。
M P E G復号化回路 2およびメモリ回路 4の書き込み処理の処理ク ロックは、 1フレーム当たり 5ブロック分のデータ ( 1 9 2 0サンプ ル） を扱う周波数であり、 また、 メモリ回路 4の読み出し処理の処理 クロックは、 1フレーム当たり 1 6 0 2 / 1 6 0 1サンプル分のデ一 夕を扱う周波数である。 メモリ回路 4は、 タイムベース機能を有して おり、 それにより、 断続的に供給される復号出力が連続するオーディ ォ信号に時間軸変換される。
メモリ回路 4では、 書き込み先頭パルスの位置から復号出力のメモ リへの書き込みが開始される。 ただし、 このとき連続したフレームで
、 且つ、 リピートフラグが立っているフレームでは、 先頭プロヅクの 書き込みが行なわれず、 2番目のブロックから書き込みが行なわれる 。 したがって、 第 1 6図の復号出力に示されるブロックだけがメモリ 回路 4のメモリに取り込まれる。
第 1 6図に示すように、 スイ ッチング点 (編集点) において、 符号 ブロックである第 5プロックと第 1 4プロヅクが隣合っている。 この ときにも、 上述した第 1、 第 2、 および第 3の実施例と同様、 復号の 過程の合成フィルタの効果によって、 隣合ったブロックの境界付近の サンプルが互いに影響し、 滑らかな出力が得られる。 . メモリ回路 4のメモリからの読み出しは、 読み出し Aおよび読み出 し Bの 2系統にわかれる。 読み出し Aは、 出力フレームパルス 1 3と オフセツ ト抽出回路 3で抽出されたオフセッ トから、 位相演算回路 5 によって作成される、 ブロック先頭パルスの位置から行なわれ、 プロ ヅク毎に先頭読み出しアドレスが補正される。 したがって、 第 1 6図 に示すように、 スィツチング （編集） により切替わったブロックに対 応するプロヅク先頭パルスの位置で、 第 5プロックの後半の位置部分 が欠落し、 第 1 4プロヅクの先頭が続いて出力される。
この実施例においては、 読み出し Bのタイ ミングを、 常に出力フレ ームパルスより 2 5 6サンプル前とすることによって、 クロスフエ一 ドの中心が常に出カフレ一ムパルスの位置に来るようにされている。 第 1 4図、 第 1 5図、 および第 1 6図に、 読み出し Bのタイ ミングを X f a d eスタートパルスとして示す。
読み出し Bは、 X f a d eスタートパルスの位置からクロスフエ一 ド期間 （第 1 6図の例では、 5 1 2サンプル） だけ出力される。 直前 に読み出し Aで読み出されたデータに続くデ一夕が読み出される。 す なわち、 第 1 6図の不連続部分では、 読み出し Aにおいて読み出され た第 5プロックの後半部分が読み出され、 続いて第 1 4プロックの先 頭が出力される。
メモリ出力 A、 Bは、 クロスフェード回路 6に供給され、 クロスフ エード処理され、 オーディオ信号 1 4として出力される。 このクロス フェード処理は、 X f a d eスタートパルスの位置から、 クロスフエ ード期間 （第 1 6図の例では、 5 1 2サンプル） およびスイッチング 点 （編集点） 以外でも、 毎回先頭ブロックの位置で行なわれる。 この とき、 スイ ッチング点 （編集点） 以外では、 メモリ出力 Aおよびメモ リ出力 Bが同一信号となるので、 クロスフエ一ド処理によって出力信 号は変化しない。 この、 クロスフェード処理が行なわれたオーディオ 信号 1 4を、 第 1 6図に X f a d e出力として示す。 クロスフエ一ド ゲインを斜め線で示している。 メモリ出力 A、 B共に合成フィルタ効 果で滑らかな信号であるから、 クロスフェード出力としてノイズの無 い出力を得ることができる。
この実施例は、 上述した第 1の実施例による方法とは異なり、 連続 したフレームを復号する場合と、 不連続なフレームを復号する場合と で、 処理の方法を変えている。 この結果、 第 1 6図に示す不連続点に おけるメモリ出力 Bが第 1 4ブロック、 第 1 5ブロックとなり、 上述 した第 1の実施例における第 9図に示すクロスフェード出力と比べ、 滑らかになる。
また同様に、 連続したフレームを復号する場合と、 不連続なフレー ムを復号する場合とで、 処理の方法を変えているために、 この例によ るクロスフエ一ド処理は、 上述したようにスィ ヅチング点 (編集点) 以外でも毎回先頭ブロックの位置で行なう必要は無く、 不連続なフレ —ムの先頭プロヅクの位置でのみ行なっても良い。
この実施例においては、 不連続なフレームの検出が必要となる。 こ の検出の一例を説明する。 この実施例においては、 5 2 5 / 5 9 . 9 4方式に 3 8 4サンプル/プロヅクの圧縮データ ( 4 8 K H z s a m p 1 i n g ) をフレーム単位で記録する。 この場合、 8 0 0 8サン プル/ 5フレームであるから、 2 4 0フレームでシーケンスが完結す る。 したがって、 毎フレーム 8 b i tの領域にフレームナンバーを符 号化の際に記録しておくことにより、 復号化の際フレームの不連続点 が検出できる。 すなわち、 0から 2 3 9の番号を順にフレーム単位に 記録しておき、 再生側で記録したフレームナンバーの不連続を検出す ることによって、 不連続なフレームの検出が可能となる。 また、 上述した、 第 2の実施例および第 3の実施例に対しても、 こ の実施例に示したように、 クロスフェードのスタートタイ ミングを出 カフレームパルスに対して一定の位相に決定することができる。 また クロスフェード期間も任意の期間を選択できる。
なお、 以上の説明においては、 圧縮データ記録単位をフレームとし たが、 これはこの例に限られるものではなく、 例えば、 1個あるいは 複数のフィ一ルドを単位としてもよい。
以上説明したように、 この発明では、 データ圧縮されたオーディオ データをビデオフレーム、 若しくはフィ一ルド単位で再生するような 機器において、 スイッチング （編集） されたデ一夕を再生する際にク ロスフエ一ドを掛けることができる。 そのため、 従来ミュート処理に よって音質が劣化していたスイ ッチング点 （編集点） において、 ノィ ズの無い滑らかな再生出力を得ることができる効果がある。

Claims

請 求 の 範 囲
1 . デ一夕圧縮されたオーディオ信号をビデオ信号のフレーム又はフ ィ一ルドに同期させて、 該フレーム又はフィールド単位で編集を行う 圧縮データ編集装置において、
入力されるオーディオ信号を入力されるプロックパルス単位で符号 化し、 該プロヅクパルスとビデオ信号のフレームとの位相差情報を検 出して符号化された符号列に付加して出力する符号化手段と
上記符号化手段から供給される符号列から上記位相差情報からオフ セッ ト値を検出して出力し、 かっこのオフセッ ト値が所定値の範囲外 であればリピートパルスを出力するオフセッ ト抽出手段と、
上記ビデオ信号のフレームパルスと上記オフセッ ト抽出手段から供 給されるオフセッ ト値からプロック先頭パルスを出力する位相演算手 段と、
上記オフセッ ト抽出手段からリピートパルスが供給されたときは入 力される符号列の復号を所定期間停止し、 リピートパルスが供給され ないときは上記符号列を復号してオーディオ信号として出力する復号 化手段と、
上記位相演算手段より供給されるプロヅク先頭パルスの位置から、 上記復号化手段からのオーディォ信号の書込みを開始し、 上記ォフセ ヅ ト抽出手段から供給されるリピートパルスが入力されるとプロヅク 先頭パルスの位置からオーディオ信号の書込みは行われず、 上記プロ ック先頭パルスが入力されるとそのパルスの位置から、 書き込まれた 上記オーディオ信号を読出して出力する第 1の出力系と、 上記プロッ ク先頭位置から所定期間第 1の出力系で出力されるオーディオ信号に 続くオーディオ信号を出力する第 2の出力系とからなるメモリ手段と 上記メモリ手段から供給されるオーディオ信号に対して上記位相演 算手段からのプロック先頭パルスの位置から上記所定期間クロスフエ ―ド処理してオーディオ信号を出力するクロスフェード処理手段とを 備えたことを特徴とする圧縮データ編集装置。
2 . 請求の範囲 1に記載の圧縮デ一夕編集装置において、
上記復号化手段は、 上記リピートパルスが入力されたときは、 上記 符号化手段から供給される符号列が繰り返しブロック化された、 リピ 一トフラグの立った符号列のブロックが入力されている間、 符号列の 符号化が停止されることを特徴とする圧縮データ編集装置。
3 . 請求の範囲 1に記載の圧縮データ編集装置において、
上記復号化手段は、 上記リピートパルスが入力されたときは、 上記 リピートパルスが入力された位置から、 所定期間上記符号列の復号を 停止することを特徴とする圧縮デ一夕編集装置。
4 . 請求の範囲 1に記載の圧縮データ編集装置において、
上記オフセヅ ト抽出手段には、 オーディオ信号符号化プロックパル スとビデオ信号のフレームパルスが供給されて、 上記ブロックパルス と上記フレームパルスの位相差からオフセヅ ト値を検出して出力する ことを特徴とする圧縮データ編集装置。
5 . 請求の範囲 1に記載の圧縮データ編集装置において、
上記メモリ手段の第 2の出力系は、 上記ブロック先頭位置からク ロスフエ一ド期間第 1の出力系で出力されるオーディオ信号に続くォ 一ディォ信号を出力することを特徴とする圧縮データ編集装置。
6 . 請求の範囲 1に記載の圧縮データ編集装置において、
上記クロスフェード処理手段は、 上記メモリ手段から供給されるォ —ディォ信号に対して上記位相演算手段からのプロック先頭パルスの 位置からクロスフエ一ド期間クロスフェード処理してオーディオ信号 を出力することを特徴とする圧縮データ編集装置。
7 . デ一夕圧縮されたオーディオ信号をビデオ信号のフレーム又はフ ィールドに同期させて、 編集を行う圧縮デ一夕編集装置において、 入力されるオーディオ信号を入力されるプロックパルス単位で符号 化し、 該ブロックパルスとビデオ信号のフレームパルスとの位相差情 報を検出して符号化された符号列に該位相差情報を付加して出力する 符号化手段と、
上記符号化手段から出力される符号列の位相差情報からオフセッ ト 値を検出して出力するオフセッ ト抽出手段と、
上記オフセッ ト抽出手段から供給されるオフセッ ト値と、 ビデオ信 号のフレームパルスが入力されてフレーム内のブロヅク先頭パルスを 出力する位相演算手段と、
ビデオ信号の編集点の位置情報を示すスィヅチングパルスを供給す るスィヅチング手段と、
上記スイッチングパルスが入力されたときは、 上記符号化手段から 供給される符号列の復号を所定期間停止し、 スィ ツチングパルスが入 力されないどきは入力される符号列を復号してオーディオ信号に変換 して出力する復号化手段と、
上記位相演算手段から供給されるプロック先頭パルスが入力された とき、 該パルスの位置から上記復号化回路から出力されるオーディオ 信号の書込みが開始され、 上記スィ ッチイング手段から供給されるス ィツチングパルスが供給されたときは、 編集点前の符号列のプロック から編集点後の最初の符号列のプロックの直前まで書込みは行われず 、 上記プロック先頭パルスが供給された位置から書き込まれた上記ォ —ディォ信号の読出しを行う第 1の出力系と、 上記ブロック先頭パル スが入力された位置から所定期間第 1の出力系から出力されるオーデ ィォ信号に続くオーディオ信号を出力する第 2の出力系からなるメモ リ手段と、
上記メモリ手段から供給されるオーディオ信号に対して、 上記位相 演算手段から供給されるプロック先頭パルスの位置から所定期間クロ スフヱ一ド処理してオーディオ信号を出力するクロスフエ一ド処理手 段を備えたことを特徴とする圧縮データ編集装置。
8 . 請求の範囲 7に記載の圧縮データ編集装置において、
上記復号化手段は、 上記スィツチングパルスが入力されたときは、 編集点前の符号列のプロックから編集点後の最初の符号列プロックの 直前まで書込みが行われないことを特徴とする圧縮データ編集装置。
9 . 請求の範囲 7に記載の圧縮データ編集装置において、
上記メモリ手段の第 2の出力系は、 上記プロック先頭パルスが入力 された位置からクロスフエ一ド期間第 1の出力系から出力されるォ一 ディォ信号に鐃くオーディオ信号を出力することを特徴とする圧縮デ —夕編集装置。
1 0 . 請求の範囲 7に記載の圧縮データ編集装置において、
上記クロスフヱ一ド処理手段は、 上記メモリ手段から供給されるォ 一ディォ信号に対して、 上記位相演算手段から供給されるプロック先 頭パルスの位置からクロスフエ一ド期間クロスフヱ一ド処理してォ一 ディォ信号を出力することを特徴とする圧縮デ一夕編集装置。
1 1 . データ圧縮されたオーディオ信号をビデオ信号のフレーム又は フィールドに同期させて編集を行う圧縮データ編集装置において、 入力されるオーディオ信号を入力されるプロックパルス単位で符号 化化し、 該ブロックパルスと入力されるビデオ信号のフレームパルス との位相差を検出して位相差情報として符号化された符号列に付加し て出力する符号化手段と、
上記符号化手段から供給される符号列から位相差情報を検出してォ フセッ ト値を検出して出力し、 かつ該オフセッ ト値が所定値の範囲外 であればリピートパルスを出力するオフセッ ト抽出手段と、
上記オフセッ ト抽出手段から供給されるリピートパルスが入力され たとき、 編集点を持たない連続したフレームの符号列のブロックが上 記符号化手段から供給されるときは、 符号列の復号は所定期間停止さ れ、 編集点を持つ不連続なフレームの符号列のプロックが供給される ときは、 上記符号列を復号し、 上記リピートパルスが入力されないと きは、 上記符号列を復号してオーディオ信号に変換して出力する復号 化手段と、
上記オフセット抽出手段から供給されるオフセット値と、 ビデオ信 号のフレームパルスが入力されて、 プロック先頭パルスを出力する位 相演算手段と、
上記位相演算手段から供給されるプロック先頭パルスと、 上記オフ セッ ト抽出手段から供給されるリピ一トパルスが入力されて、 上記ブ 口ヅク先頭パルスの位置から上記復号化手段から供給されるオーディ ォ信号の書込みが行われ、 編集点を持たない連続したオーディオ信号 でかつリピ一トパルスを供給する符号列に対応するオーディオ信号は 所定期間書込みが行われず、 上記プロック先頭パルスが入力されると 該パルスの位置から書き込まれたオーディオ信号を読出して出力する 第 1の出力系と、 上記先頭プロックパルスの位置から所定期間第 1の 出力系から読み出されたオーディオ信号に続くオーディオ信号を読出 して出力する第 2の出力系からなるメモリ手段と、
上記メモリ手段から供給されるオーディオ信号が入力されて、 上記 位相演算手段より供給される先頭プロヅクパルスの位置から所定期間 クロスフヱ一ド処理してオーディオ信号を出力するクロスフエ一ド手 段とを備えたことを特徴とする圧縮データ編集装置。
1 2 . 請求の範囲 1 1に記載の圧縮データ編集装置において、 上記復号化手段は、 上記リピートパルスが入力されたとき編集点を 持たない連続したフレームの符号列のプロックが上記符号化手段から 供給されるときは符号列の復号は、 上記符号化手段から繰り返し符号 列がプロック化された、 リピートフラグの立った符号列のプロックが 入力されている期間、 上記符号列の符号化が停止されていることを特 徴とする圧縮データ編集装置。
1 3 . 請求の範囲 1 1に記載の圧縮デ一夕編集装置において、 上記復号化手段は、 上記リピートパルスが入力されたとき編集点を 持たない連続したフレームの符号列のプロックが上記符号化手段から 供給されるときは、 上記リピートパルスが入力された位置から、 所定 期間上記符号列の復号を停止することを特徴とする圧縮データ編集装 B o
1 4 . 請求の範囲 1 1に記載の圧縮デ一夕編集装置において、 上記オフセッ ト抽出手段は、 オーディオ信号の符号化プロックパル スとビデオ信号のフレームパルスが供給されて、 上記プロヅクパルス と上記フレームパルスの位相差からオフセッ ト値を検出して出力する ことを特徴とする圧縮データ編集装置。
1 5 . 請求の範囲 1 1に記載の圧縮デ一夕編集装置において、 上記メモリ手段の第 2の出力系は、 上記プロック先頭パルスの位置 からクロスフエ一ド期間上記第 1の出力系で出力されるオーディオ信 号に続くオーディオ信号を出力することを特徴とする圧縮デ一夕編集 装置。
1 6 . 請求の範囲 1 1に記載の圧縮データ編集装置において、 上記ク tlスフエード処理手段は、 上記メモリ手段から供給されるォ —ディォ信号に対して上記位相演算手段から供給されるプロック先頭 パルスの位置からクロスフエ一ド期間クロスフエ一ド処理してオーデ ィォ信号を出力することを特徴とする圧縮デ一夕編集装置。
1 7 . 請求の範囲 1 1に記載の圧縮デ一夕編集装置において、 上記メモリ手段は、 編集点を持たない連続したオーディオ信号でか つ上記リピートパルスを供給する符号列に対応するオーディオ信号は 、 フレーム内の先頭プロックの書込みは単位ブロック期間行われない ことを特徴とする圧縮データ編集装置。
1 8 . 請求の範囲 1 1に記載の圧縮データ編集装置において、 上記メモリ手段の第 2の出力系の読出しは、 ビデオ信号のフレーム パルスより所定期間早めて読出しを行うことを特徴とする圧縮データ 編集装置。
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