WO2002065291A3 - Dispositif de reconfiguration d'un ensemble memoire presentant des defauts - Google Patents

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Abstract

L'invention concerne un dispositif de reconfiguration d'un ensemble de N modules électroniques de base associés à k modules redondants, comprenant: N multiplexeurs ayant chacun une première borne (di) susceptible d'être connectée à l'une de k+1 deuxièmes bornes connectées aux k+1 bornes d'entrée/sortie d'un groupe ordonné de modules composé d'un module de base (Ui) et de k autres modules; N+k bascules (Fi) indicatrices d'un état bon ou mauvais d'un des N+k modules; et un moyen logique associé à chaque multiplexeur de rang j, j étant un entier compris entre 0 et N, pour déterminer le nombre de bascules de rang 0 à j indiquant un état mauvais, déterminer le nombre de modules du groupe ordonné associé au module de rang j, à compter pour trouver un nombre de modules bons égal au premier nombre, et connecter la première borne du multiplexeur à sa deuxième borne de rang égal au deuxième nombre.
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Families Citing this family (7)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7203873B1 (en) 2004-06-04 2007-04-10 Magma Design Automation, Inc. Asynchronous control of memory self test
US20060182187A1 (en) * 2005-02-11 2006-08-17 Likovich Robert B Jr Automatic reconfiguration of an I/O bus to correct for an error bit
JP4821198B2 (ja) * 2005-07-12 2011-11-24 ソニー株式会社 半導体集積回路とその製造方法
JP4552803B2 (ja) * 2005-08-10 2010-09-29 ソニー株式会社 半導体集積回路
US20090177919A1 (en) * 2008-01-04 2009-07-09 International Business Machines Corporation Dynamic redundancy for microprocessor components and circuits placed in nonoperational modes
US7783940B2 (en) * 2008-06-06 2010-08-24 Syntest Technologies, Inc. Apparatus for redundancy reconfiguration of faculty memories
MA55238B1 (fr) * 2021-12-23 2023-10-31 Nabil Guennoun Dispositif de protection, de réparation ou de changement de comportement d’un circuit électrique ou électronique utilisant une fonction de remplacement d’un composant à l'aide d'une commutation redondante.

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6151263A (en) * 1997-12-04 2000-11-21 Samsung Electronics Co., Ltd. Integrated circuit memory devices having data input and output lines extending along the column direction

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5833577B2 (ja) * 1977-03-17 1983-07-20 富士通株式会社 集積回路
US4355391A (en) * 1980-03-31 1982-10-19 Texas Instruments Incorporated Apparatus and method of error detection and/or correction in a data set

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6151263A (en) * 1997-12-04 2000-11-21 Samsung Electronics Co., Ltd. Integrated circuit memory devices having data input and output lines extending along the column direction

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