DE4244419A1 - - Google Patents
Info
- Publication number
- DE4244419A1 DE4244419A1 DE4244419A DE4244419A DE4244419A1 DE 4244419 A1 DE4244419 A1 DE 4244419A1 DE 4244419 A DE4244419 A DE 4244419A DE 4244419 A DE4244419 A DE 4244419A DE 4244419 A1 DE4244419 A1 DE 4244419A1
- Authority
- DE
- Germany
- Prior art keywords
- circuit
- counter
- output
- receiving
- flip
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Ceased
Links
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/04—Synchronising
- H04N5/06—Generation of synchronising signals
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/04—Synchronising
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/04—Synchronising
- H04N5/08—Separation of synchronising signals from picture signals
- H04N5/10—Separation of line synchronising signal from frame synchronising signal or vice versa
Description
Die vorliegende Erfindung bezieht sich auf die
Videosignalverarbeitung und insbesondere auf eine Schaltung
zur Ermittlung der ungerade und gerade numerierten
Teilbilder eines Videosignals.
Üblicherweise erreicht man die Ermittlung der ungerade und
gerade numerierten Teilbilder eines Videosignals mittels
eines Softwareprogramms. In diesem Falle ist es üblich,
einen Mikrocomputer und zusätzliche periphere Vorrichtungen
zu verwenden, um die Teilbildermittlung zu steuern. Das
Softwareprogramm neigt jedoch gelegentlich dazu,
Programmfehler zu verursachen. Immer wenn ein solcher
Programmfehler auftritt, muß das Softwareprogramm
rückgesetzt werden, um es neu zu starten. Die
Zuverlässigkeit der Teilbildermittlung eines Videosignals
wird dadurch herabgesetzt.
Der Erfindung liegt daher die Aufgabe zugrunde, eine
Schaltung zur Ermittlung der ungerade und gerade numerierten
Teilbilder eines Videosignals mit Hilfe von Hardware
anzugeben.
Diese Aufgabe wird durch die im Anspruch 1 angegebene
Erfindung gelöst. Vorteilhafte Ausgestaltungen der Erfindung
sind Gegenstand der Unteransprüche.
Die Erfindung wird nachfolgend unter Bezugnahme auf die
Zeichnungen näher erläutert. Es zeigt.
Fig. 1 eine Schaltung zur Ermittlung der ungerade und
gerade numerierten Teilbilder eines Videosignals
gemäß der vorliegenden Erfindung, und
Fig. 2A bis 2L Signalverläufe in verschiedenen Abschnitten
von Fig. 1.
Die Schaltung nach Fig. 1 enthält einen ersten Zähler 100
mit einer UND-Schaltung 15, einem Synchronzähler 10, einer
zweiten UND-Schaltung 20 und einem JK-Flip-Flop 30. Die
erste UND-Schaltung 15 empfängt zusammengesetzte
Synchronimpulse von einem Synchronimpulsgenerator (nicht
dargestellt) über einen Inverter 12 und Rücksetzimpulse von
einer nicht gezeigten Rücksetzschaltung. Die zweite
UND-Schaltung 20 empfängt die Ausgänge des Synchronzählers
10, um daraus den Startpunkt eines Vertikalsynchronimpuls
intervalls zu ermitteln (siehe Fig. 2D).
Eine zweite Zählschaltung 200 enthält erste und zweite
4-Bit-Synchronzähler 40 und 50, die parallelgeschaltet sind,
um einen 8-Bit-Zähler zu bilden, eine dritte UND-Schaltung
60, eine ODER-Schaltung 70 und ein JK-Flip-Flop 80. Der
8-Bit-Zähler empfängt den Ausgang S2 (Fig. 4E) der ersten
Zählschaltung 100 und die Ausgangsimpulse vom
Taktimpulsgenerator und der Rücksetzschaltung, um ein
Fenstersignal S5 (Fig. 2H) zu erzeugen, das die
Horizontalsynchronimpulse S6 der geradzahligen und
ungeradzahligen Teilbilder überdeckt. Diese
Horizontalsynchronimpulse S6 (Fig. 2I und 2J) werden als
erstes nach dem Beginn des Vertikalsynchronimpulsintervalls
empfangen. Die ODER-Schaltung 70 empfängt die Ausgänge des
zweiten 4-Bit-Synchronzählers 50, um einen Ausgang S4 (Fig.
2G) zu erzeugen, der in den logisch "hohen" Zustand
übergeht, wenn der zweite Synchronzähler 50 wenigstens 16
Taktimpulse zählt.
Eine Teilbilddetektorschaltung 300 enthält eine vierte
UND-Schaltung 90 und ein D-Flip-Flop 95. Die
Teilbilddetektorschaltung 300 empfängt die Signale S4 und S5
von der zweiten Zählschaltung 200 und die
Horizontalsynchronimpulse S6 (Fig. 2I und 2J), um
ungeradzahlige und geradzahlige Teilbildsignale an einem
Ausgangsanschluß OUT zu erzeugen.
Es sei angemerkt, daß die Schaltung von Fig. 1 Taktimpulse
einer Frequenz von 500 kHz verwendet (d. h. mit einer Periode
von 2 µSek.). Die zusammengesetzten Synchronimpulse von Fig.
2A haben ein Ausgleichsimpulsintervall und ein
Vertikalsynchronimpulsintervall. Für das
Ausgleichsimpulsintervall dauern die logisch "niedrigen"
Zustände der Impulse über eine Zeit von 2,3 µSek. an. Für das
Vertikalssynchronimpulsintervall dauern die logisch
"niedrigen" Zustände der Impulse jedoch für etwa 27 µSek. an.
Der Betrieb der Schaltung nach Fig. 1 wird nun unter
Bezugnahme auf die Fig. 1 und 2A bis 2L erläutert.
Zunächst zählt der Synchronzähler 10 die Taktimpulse einer
Periode von 2 µSek. in Zuordnung zu den zusammengesetzten
Synchronimpulsen und dem Rücksetzimpuls, der über die erste
UND-Schaltung 15 empfangen wird. Wenn der Synchronzähler 10
8 Taktimpulse zählt (d. h. 16 µSek.), dann erzeugt die zweite
UND-Schaltung 20 ein Ausgangssignal S1 von logisch "hohem"
Zustand.
Da jedoch für das Ausgleichsimpulsintervall der logisch
"niedrige" Zustand der Impulse für etwa 2,3 µSek. anhält,
kann der Synchronzähler 10 in Abhängigkeit vom logisch
"hohen" Zustand der zusammengesetzten Synchronimpulse, die
der ersten UND-Schaltung 15 über den Inverter 12 zugeführt
werden, vor dem Zählen der 8 Taktimpulse gelöscht werden, so
daß das Ausgangssignal S2 des JK-Flip-Flops 30 während des
Ausgleichsimpulsintervalls nicht auf den logisch "hohen"
Zustand gehen kann. Andererseits kann jedoch der
Synchronzähler 10 maximal 14 Taktimpulse (d. h. 28 µSek.)
während des Vertikalsynchronimpulsintervalls zählen, bei dem
die Dauer des logisch "niedrigen" Zustands etwa 27 µSek.
beträgt. Die erste Zählschaltung 100 hat daher einen
ausreichenden Zeitrahmen, um 8 Taktimpulse (16 µSek.) für das
Vertikalsynchronimpulsintervall zu zählen, um das
Vertikalsynchronimpulsintervall zu ermitteln.
Dementsprechend ermöglicht der Synchronzähler 10 durch
Zählen von 8 Taktimpulsen im Vertikalsynchronimpulsintervall
dem JK-Flip-Flop 30, den logisch hohen Zustand am Ausgang
"Q" zu erzeugen. Im gleichen Augenblick wird der
Synchronzähler 10 durch den logisch niedrigen Zustand am
invertierten Ausgang "Q" des JK-Flip-Flop 30 gelöscht, und
er erlaubt es, dem JK-Flip-Flop 30 weiterhin, den logisch
hohen Zustand aufrechtzuerhalten, wobei die nächsten sechs
Vertikalsynchronimpulse ignoriert werden.
In der Zwischenzeit beginnt der 8-Bit-Zähler zu arbeiten, da
der Ausgang S2 des JK-Flip-Flops 30 sich auf logisch hohem
Zustand befindet. Die Taktimpulse werden dann durch den
8-Bit-Zähler (40, 50) gezählt, bis einer der nächsten
Horizontalsynchronimpulse für ungerade oder gerade
Teilbilder (Fig. 2B und 2C) ermittelt wird, um die Signale
S3 und S4 zu erzeugen.
Das Signal S3 von der dritten UND-Schaltung 60 geht auf
logisch "hoch", wenn der 8-Bit-Zähler 30 Taktimpulse zählt,
d. h. 60 µSek.. Das Fenstersignal S5, das durch das Signal S2
logisch hohem Zustandes von der ersten UND-Schaltung 20
"hoch" wurde, geht durch das Signal S3 logisch hohen
Zustandes von der dritten UND-Schaltung 60 dann auf logisch
"niedrig" um das Fenstersignal S5 von 60 µSek. Dauer zu
bilden (die für die Zählung von 30 Taktimpulsen
erforderliche Zeit). Die Horizontalsynchronimpulseingabe
wird zum D-Flip-Flop als ein Taktimpuls über die vierte
UND-Schaltung 90 nur dann Übertragen, wenn das Fenstersignal
S5 vom JK-Flip-Flop 80 logisch "hoch" ist. Die Signale S6
(Fig. 2I und 2J) von der fünften UND-Schaltung 90 takten
daher das D-Flip-Flop 95, um das ungerade oder gerade
Feldsignal gemäß dem Signal S4 zu erzeugen.
Im Falle des geradzahligen Feldes wird das D-Flip-Flop 95
durch das Signal S6 (Fig. 2I) getaktet, das von der vierten
UND-Schaltung 90 abgegeben wird und auf logisch "hoch"
ungefähr 15 µSek. (die zum Zählen von 7 oder 8 Taktimpulsen
erforderliche Zeit) nach Beginn des Fenstersignals S5 (Fig.
2H und 2I) geht. In diesem Augenblick ist das Signal S4
(Fig. 2G) am Ausgang der ODER-Schaltung 70 logisch
"niedrig", weil die oberen vier Bits des 8-Bit-Zählers
sämtlich logisch "niedrig" sind. Das D-Flip-Flop 95 bleibt
daher im logisch niedrigen Zustand, bis das nächste
Vertikalsynchronimpulsintervall ermittelt wird.
In der Zwischenzeit wird im Falle des ungeraden Feldes das
D-Flip-Flop durch das Signal S6 (Fig. 2J) getaktet, das von
der vierten UND-Schaltung 90 abgegeben wird und auf logisch
"niedrig" ungefähr 46 µSek. (die Zeit zum Zählen von 23
Taktimpulsen) nach Beginn des Fenstersignals S5 (Fig. 2H und
2J) geht. In diesem Augenblick ist das Signal S4 (Fig. 2G)
am Ausgang der ODER-Schaltung 70 auf logisch hohem Zustand,
weil wenigstens eines der oberen vier Bits des 8-Bit-Zählers
40, 50 logisch "hoch" ist. Das D-Flip-Flop 95 bleibt daher
in logisch hohem Zustand bis zur Ermittlung des nächsten
Vertikalsynchronimpulsintervalls.
Folglich erzeugt das D-Flip-Flop 95 am Ausgang Q (OUT) den
logisch "niedrigen" Zustand für das gerade Feld und den
logisch "hohen" Zustand für das ungerade Feld.
Claims (4)
1. Schaltung zur Ermittlung der ungeraden und geraden
Teilbilder eines zugeführten Videosignals, enthaltend:
eine erste Zähleinrichtung zum Zählen eines zugeführten Taktimpulses zur Ermittlung eines Vertikalsynchronimpulsintervalls des Videosignals;
einen zweiten Zähler zum Zählen des Taktimpulses bei Ermittlung des Vertikalsynchronimpulsintervalls, um ein Fenstersignal und ein Zählsignal vorbestimmter Impulsbreite zu erzeugen; und
eine Ausgabeeinrichtung, die in Abhängigkeit von Horizontalsynchronimpulsen und Fenstersignal einen ersten logischen Zustand erzeugt, der für ein nächstes Vertikalsynchronimpulsintervall aufrechterhalten bleibt, und einen zweiten logischen Zustand erzeugt, der für das nächste Vertikalsynchronimpulsintervall aufrechterhalten bleibt,
wodurch die Ausgabeeinrichtung den ersten Logikzustand für das ungerade Teilbild und den zweiten Logikzustand für das gerade Teilbild aufrechterhält.
eine erste Zähleinrichtung zum Zählen eines zugeführten Taktimpulses zur Ermittlung eines Vertikalsynchronimpulsintervalls des Videosignals;
einen zweiten Zähler zum Zählen des Taktimpulses bei Ermittlung des Vertikalsynchronimpulsintervalls, um ein Fenstersignal und ein Zählsignal vorbestimmter Impulsbreite zu erzeugen; und
eine Ausgabeeinrichtung, die in Abhängigkeit von Horizontalsynchronimpulsen und Fenstersignal einen ersten logischen Zustand erzeugt, der für ein nächstes Vertikalsynchronimpulsintervall aufrechterhalten bleibt, und einen zweiten logischen Zustand erzeugt, der für das nächste Vertikalsynchronimpulsintervall aufrechterhalten bleibt,
wodurch die Ausgabeeinrichtung den ersten Logikzustand für das ungerade Teilbild und den zweiten Logikzustand für das gerade Teilbild aufrechterhält.
2. Schaltung nach Anspruch 1, bei der der erste Zähler
enthält:
eine erste UND-Schaltung zur Entgegennahme zusammengesetzter Synchronimpulse und eines Rücksetzimpulses,
einen Synchronzähler zum Zählen der Taktimpulse,
eine zweite UND-Schaltung zur Aufnahme des Ausgangs des Synchronzählers zur Ermittlung des Vertikalsynchronimpulsintervalls daraus, und
ein erstes JK-Flip-Flop, das auf den Ausgang der zweiten UND-Schaltung anspricht.
eine erste UND-Schaltung zur Entgegennahme zusammengesetzter Synchronimpulse und eines Rücksetzimpulses,
einen Synchronzähler zum Zählen der Taktimpulse,
eine zweite UND-Schaltung zur Aufnahme des Ausgangs des Synchronzählers zur Ermittlung des Vertikalsynchronimpulsintervalls daraus, und
ein erstes JK-Flip-Flop, das auf den Ausgang der zweiten UND-Schaltung anspricht.
3. Schaltung nach Anspruch 1, bei der der zweite Zähler
enthält:
erste und zweite 4-Bit-Synchronzähler, die parallelgeschaltet sind, um einen 8-Bit-Zähler zu bilden zum Zählen der Taktimpulse bei Empfang des Ausgangs des ersten JK-Flip-Flops,
eine dritte UND-Schaltung zur Aufnahme des Ausgangs des 8-Bit-Synchron-Zählers;
eine ODER-Schaltung zur Aufnahme des Ausgangs des zweiten 4-Bit-Synchronzählers zur Erzeugung des Zählsignals, und
ein zweites JK-Flip-Flop zur Aufnahme der Ausgänge der zweiten und dritten UND-Schaltungen zur Erzeugung des Fenstersignals.
erste und zweite 4-Bit-Synchronzähler, die parallelgeschaltet sind, um einen 8-Bit-Zähler zu bilden zum Zählen der Taktimpulse bei Empfang des Ausgangs des ersten JK-Flip-Flops,
eine dritte UND-Schaltung zur Aufnahme des Ausgangs des 8-Bit-Synchron-Zählers;
eine ODER-Schaltung zur Aufnahme des Ausgangs des zweiten 4-Bit-Synchronzählers zur Erzeugung des Zählsignals, und
ein zweites JK-Flip-Flop zur Aufnahme der Ausgänge der zweiten und dritten UND-Schaltungen zur Erzeugung des Fenstersignals.
4. Schaltung nach Anspruch 1, bei der die Ausgabeeinrichtung
enthält:
eine vierte UND-Schaltung zur Aufnahme des Fenstersignals und der Vertikalsynchronimpulse zur Erzeugung eines Untertaktimpulses, und
ein D-Flip-Flop zur Aufnahme des Zählsignals zur Aufrechterhaltung des Logikzustands des Zählsignals in Abhängigkeit vom Untertaktimpuls.
eine vierte UND-Schaltung zur Aufnahme des Fenstersignals und der Vertikalsynchronimpulse zur Erzeugung eines Untertaktimpulses, und
ein D-Flip-Flop zur Aufnahme des Zählsignals zur Aufrechterhaltung des Logikzustands des Zählsignals in Abhängigkeit vom Untertaktimpuls.
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019910025679A KR950005054B1 (ko) | 1991-12-31 | 1991-12-31 | 기수/우수의 필드 검출장치 |
Publications (1)
Publication Number | Publication Date |
---|---|
DE4244419A1 true DE4244419A1 (de) | 1993-07-01 |
Family
ID=19327153
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
DE4244419A Ceased DE4244419A1 (de) | 1991-12-31 | 1992-12-29 |
Country Status (6)
Country | Link |
---|---|
US (1) | US5327175A (de) |
JP (1) | JP2549492B2 (de) |
KR (1) | KR950005054B1 (de) |
CN (1) | CN1043000C (de) |
DE (1) | DE4244419A1 (de) |
GB (1) | GB2263028B (de) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE19801732A1 (de) * | 1998-01-19 | 1999-07-22 | Thomson Brandt Gmbh | Schaltung zur Aufbereitung von Synchronsignalen |
Families Citing this family (20)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US6097543A (en) | 1992-02-07 | 2000-08-01 | I-O Display Systems Llc | Personal visual display |
US5303085A (en) | 1992-02-07 | 1994-04-12 | Rallison Richard D | Optically corrected helmet mounted display |
US5864326A (en) | 1992-02-07 | 1999-01-26 | I-O Display Systems Llc | Depixelated visual display |
US5526022A (en) | 1993-01-06 | 1996-06-11 | Virtual I/O, Inc. | Sourceless orientation sensor |
JPH06245098A (ja) * | 1993-02-16 | 1994-09-02 | Sharp Corp | フィールド決定回路 |
US5991087A (en) | 1993-11-12 | 1999-11-23 | I-O Display System Llc | Non-orthogonal plate in a virtual reality or heads up display |
US6160666A (en) | 1994-02-07 | 2000-12-12 | I-O Display Systems Llc | Personal visual display system |
US5903395A (en) | 1994-08-31 | 1999-05-11 | I-O Display Systems Llc | Personal visual display system |
US6226044B1 (en) * | 1994-11-30 | 2001-05-01 | The United States Of America As Represented By The Secretary Of The Army | Field synchronization system and technique |
US5608461A (en) * | 1995-03-29 | 1997-03-04 | Silicon Graphics, Inc. | Programmable video frame detector |
EP0737004A1 (de) * | 1995-04-05 | 1996-10-09 | Thomson Consumer Electronics, Inc. | Halbbild Diskriminierschaltung für ein Videosignal |
US5991085A (en) | 1995-04-21 | 1999-11-23 | I-O Display Systems Llc | Head-mounted personal visual display apparatus with image generator and holder |
US6122604A (en) * | 1996-12-02 | 2000-09-19 | Dynacolor Inc. | Digital protection circuit for CRT based display systems |
TW468339B (en) * | 1998-09-14 | 2001-12-11 | Sony Corp | External synchronizing system and camera system using thereof |
GB2362754A (en) * | 2000-05-25 | 2001-11-28 | Nanogate Ltd | A method of growing single crystals |
FR2831755A1 (fr) * | 2001-10-30 | 2003-05-02 | St Microelectronics Sa | Procede et dispositif de detection de la parite des trames successives d'un signal video entrelace |
AU2005253141A1 (en) * | 2004-06-07 | 2005-12-22 | Cfph, Llc | System and method for managing financial market information |
US7499098B2 (en) * | 2005-06-07 | 2009-03-03 | Seiko Epson Corporation | Method and apparatus for determining the status of frame data transmission from an imaging device |
JP5849245B2 (ja) | 2010-07-28 | 2016-01-27 | パナソニックIpマネジメント株式会社 | レーダ装置 |
CN104320564B (zh) * | 2014-10-22 | 2018-03-16 | 中国电子科技集团公司第四十一研究所 | 一种基于fpga实现视频信号触发同步的方法 |
Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3443925C1 (de) * | 1984-12-01 | 1986-01-30 | Philips Patentverwaltung Gmbh, 2000 Hamburg | Schaltungsanordnung zum Unterscheiden der beiden Halbbilder in einem Fernsehsignal |
US5025496A (en) * | 1990-05-07 | 1991-06-18 | Rca Licensing Corporation | Odd/even field detector for video signals |
Family Cites Families (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPS5714258A (en) * | 1980-06-30 | 1982-01-25 | Mitsubishi Electric Corp | Field discrimination circuit for television signal |
JPS6051301B2 (ja) * | 1980-08-14 | 1985-11-13 | 松下電器産業株式会社 | フィ−ルド識別装置 |
US4827341A (en) * | 1986-12-16 | 1989-05-02 | Fuji Photo Equipment Co., Ltd. | Synchronizing signal generating circuit |
-
1991
- 1991-12-31 KR KR1019910025679A patent/KR950005054B1/ko not_active IP Right Cessation
-
1992
- 1992-12-28 JP JP4349254A patent/JP2549492B2/ja not_active Expired - Fee Related
- 1992-12-29 DE DE4244419A patent/DE4244419A1/de not_active Ceased
- 1992-12-30 US US07/998,726 patent/US5327175A/en not_active Expired - Lifetime
- 1992-12-31 GB GB9227138A patent/GB2263028B/en not_active Expired - Fee Related
- 1992-12-31 CN CN92113848A patent/CN1043000C/zh not_active Expired - Fee Related
Patent Citations (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE3443925C1 (de) * | 1984-12-01 | 1986-01-30 | Philips Patentverwaltung Gmbh, 2000 Hamburg | Schaltungsanordnung zum Unterscheiden der beiden Halbbilder in einem Fernsehsignal |
US5025496A (en) * | 1990-05-07 | 1991-06-18 | Rca Licensing Corporation | Odd/even field detector for video signals |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE19801732A1 (de) * | 1998-01-19 | 1999-07-22 | Thomson Brandt Gmbh | Schaltung zur Aufbereitung von Synchronsignalen |
US6498629B1 (en) | 1998-01-19 | 2002-12-24 | Thomson Licensing Sa | Conditioning synchronization signals based on line-by-line display of video signals |
Also Published As
Publication number | Publication date |
---|---|
US5327175A (en) | 1994-07-05 |
JPH0686093A (ja) | 1994-03-25 |
KR950005054B1 (ko) | 1995-05-17 |
GB2263028A (en) | 1993-07-07 |
GB9227138D0 (en) | 1993-02-24 |
JP2549492B2 (ja) | 1996-10-30 |
CN1043000C (zh) | 1999-04-14 |
KR930015669A (ko) | 1993-07-24 |
CN1076580A (zh) | 1993-09-22 |
GB2263028B (en) | 1995-09-13 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
DE4244419A1 (de) | ||
DE3443925C1 (de) | Schaltungsanordnung zum Unterscheiden der beiden Halbbilder in einem Fernsehsignal | |
DE3033356C2 (de) | Zitterkorrektur-Schaltungsanordnung für einen digitalen Oszillographen. | |
DE2702453A1 (de) | Farbfernsehsignal-verarbeitungsschaltung | |
DE2951023C2 (de) | Schaltungsanordnung zum Erkennen von Störungen in Impulssignalen | |
DE2811725C2 (de) | ||
DE3815531C2 (de) | ||
DE4428703C2 (de) | Abtrennvorrichtung für vertikale Synchronsignale | |
DE3435097C2 (de) | ||
DE3744470C2 (de) | ||
DE3212655C2 (de) | ||
DE69636190T2 (de) | Schaltung zum Erzeugen eines Horizontal-Synchronisierungssignals und Verfahren dazu | |
DE2943630C2 (de) | Verfahren und Vorrichtung zur Messung einer Funktionskenngröße einer Uhr | |
DE3642193A1 (de) | Bildanzeigevorrichtung | |
DE2352772C2 (de) | Frequenzwandler | |
DE3217228A1 (de) | Digitalschaltung zur feststellung eines korrekten fernsehsynchronisierausgangssignals zur verwendung bei einem suchlauf-abstimmsystem | |
DE1256689C2 (de) | Taktgeber mit einer einrichtung zur abschaltung und zur phasenrichtigen wiedereinschaltung der taktsignale von elektronischen datenverarbeitenden anlagen | |
DE3924921C2 (de) | ||
DE3325247A1 (de) | Schaltungsanordnung zum testen einer digitalen schaltung | |
DE2923911C2 (de) | Schaltungsanordnung zur Erzeugung von Synchronimpulsen für die Vertikal-Ablenkstufe in Fernsehempfängern | |
DE2360094B2 (de) | Verfahren und Vorrichtung zum Zählen von Schrotkugeleinschlägen auf einer Prüfscheibe | |
DE4021268A1 (de) | Pulsdauermodulations-signalgenerator | |
DE2525288C2 (de) | Verfahren und Schaltungsanordnung zur automatischen Regulierung einer elektronischen Hauptuhr | |
DE2517046C2 (de) | Fernsehimpulsgeber | |
CH628764A5 (en) | Method of remote synchronisation of a colour television clock generator according to the CCIR PAL standard |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
8110 | Request for examination paragraph 44 | ||
8131 | Rejection |